參數(shù)資料
型號(hào)： GCIXP1250-166
英文描述： Microprocessor
中文描述： 微處理器
文件頁數(shù)： 123/148頁
文件大?。?/td> 1601K
代理商： GCIXP1250-166
Intel
IXP1250 Network Processor
Datasheet
123
Table 48. SRAM Bus Signal Timing
1
,
2
1. Timing parameters assume that the system uses a zero delay clock buffer for SCLK before it is distributed to SRAM.
2. When used as a rdy input, HIGH_EN_L is asynchronous and can change anywhere relative to SCLK.
3. Capacitive loading effects on signal lines are shown in
Table 49
.
4. T
(min) and 166 MHz and 200 MHz T
(min) parameters are tested under 0 pF load best case conditions (Vdd=2.1,
Vddx=3.6, Temp=0 degrees C) at 1.15 nsec with an uncertainty of 0.25 nsec. The parameter specified is guaranteed by design
in a minimally configured system environment.
5. Timings are what the tester must measure. Add 0.25 nsec to these numbers to obtain system AC parameter. This
additional 0.25 nsec is needed to allow for SRAM drive derating.
6. Not tested. Guaranteed by design.
Symbol
Parameter
Minimum
(IXP1250 Core
Speed)
Maximum
(IXP1250 Core
Speed)
Unit
166
MHz
200
MHz
232
MHz
166
MHz
200
MHz
232
MHz
T
val
Clock to data output valid delay
3,4
1.0
1.0
0.5
5.0
4.5
3.35
ns
T
ctl
Clock to control outputs valid delay
3,4
1.25
1.0
0.5
5.0
4.5
3.05
ns
T
suf
Data input setup time before NA/SACLK
for Flowthru SRAM
2
2
2
---
---
---
ns
T
sup
Data input setup time before SCLK for
Pipelined SRAM
5.5
5.0
3.10
---
---
---
ns
T
hf
Input signal hold time from NA/SACLK
for Flowthru SRAM
1
1
1
---
---
---
ns
T
hp
Input signal hold time from SCLK for
Pipelined SRAM
1
1
0.75
---
---
---
ns
T
on
6
T
off
6
Float-to-active delay from clock
1
1
1
---
---
---
ns
Active-to-float delay from clock
---
---
---
3
3
3
ns
Table 49. Signal Delay Deratings for T
val
and T
ctl
Signal
Maximum Derating (ns/pF)
(IX Bus Speed)
Minimum Derating (ns/pF)
(IX Bus Speed)
83 MHz
100 MHz
116 MHz
83 MHz
100 MHz
116 MHz
SCLK
0.053
—
—
0.025
—
—
SLOW_EN_L
0.065
0.06
0.031
0.03
0.025
0.015
SWE_L
0.065
0.06
0.031
0.03
0.025
0.015
MRD_L
0.065
0.06
0.031
0.03
0.025
0.015
MCE_L
0.065
0.06
0.031
0.03
0.025
0.015
SOE_L
0.065
0.06
0.031
0.03
0.025
0.015
HIGH_EN_L
0.065
0.06
0.031
0.03
0.025
0.015
LOW_EN_L
0.065
0.06
0.031
0.03
0.025
0.015
CE_L[3:0]
0.065
0.06
0.031
0.03
0.025
0.015
A[18:0]
0.065
0.06
0.031
0.03
0.025
0.015
DQ[31:0]
0.065
0.06
0.031
0.03
0.025
0.015
FWE_L
0.065
0.06
0.031
0.03
0.025
0.015
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