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參數(shù)資料
| 型號： | DSF10K |
| 廠商： | Altera Corporation |
| 英文描述： | EMBEDDED PROGRAMMABLE LOGIC FAMILY |
| 中文描述： | 嵌入式可編程邏輯系列 |
| 文件頁數(shù)： | 45/138頁 |
| 文件大?。?/td> | 2116K |
| 代理商： | DSF10K |
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Altera Corporation
45
FLEX 10K Embedded Programmable Logic Family Data Sheet
Notes to tables:
(1)
See the
Operating Requirements for Altera Devices Data Sheet
.
(2)
Minimum DC input voltage is –0.5 V. During transitions, the inputs may undershoot to –2.0 V for input currents
less than 100 mA and periods shorter than 20 ns.
(3)
Numbers in parentheses are for industrial-temperature-range devices.
(4)
Maximum V
CC
rise time is 100 ms. V
CC
must rise monotonically.
(5)
Typical values are for T
A
= 25
°
C and V
CC
= 5.0 V.
(6)
These values are specified under
Table 18
on
page 44
.
(7)
The I
OH
parameter refers to high-level TTL or CMOS output current.
(8)
The I
OL
parameter refers to low-level TTL or CMOS output current. This parameter applies to open-drain pins as
well as output pins.
(9)
Capacitance is sample-tested only.
Table 20. 5.0-V Device Capacitance of EPF10K10, EPF10K20 & EPF10K30 Devices
Note (9)
Symbol
Parameter
Conditions
Min
Max
Unit
C
IN
C
INCLK
Input capacitance
Input capacitance on dedicated
clock pin
Output capacitance
V
IN
= 0 V, f = 1.0 MHz
V
IN
= 0 V, f = 1.0 MHz
8
pF
pF
12
C
OUT
V
OUT
= 0 V, f = 1.0 MHz
8
pF
Table 21. 5.0-V Device Capacitance of EPF10K40, EPF10K50, EPF10K70 & EPF10K100 Devices
Note (9)
Symbol
Parameter
Conditions
Min
Max
Unit
C
IN
C
INCLK
Input capacitance
Input capacitance on dedicated
clock pin
Output capacitance
V
IN
= 0 V, f = 1.0 MHz
V
IN
= 0 V, f = 1.0 MHz
10
15
pF
pF
C
OUT
V
OUT
= 0 V, f = 1.0 MHz
10
pF
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PDF描述 |
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