參數(shù)資料
型號(hào)： DSF10K
廠商： Altera Corporation
英文描述： EMBEDDED PROGRAMMABLE LOGIC FAMILY
中文描述： 嵌入式可編程邏輯系列
文件頁數(shù)： 117/138頁
文件大小： 2116K
代理商： DSF10K
Altera Corporation
117
FLEX 10K Embedded Programmable Logic Family Data Sheet
Notes to tables:
(1)
All timing parameters are described in
Tables 32
through
38
in this data sheet.
(2)
Using an LE to register the signal may provide a lower setup time.
(3)
This parameter is specified by characterization.
ClockLock &
ClockBoost
Timing
Parameters
For the ClockLock and ClockBoost circuitry to function properly, the
incoming clock must meet certain requirements. If these specifications are
not met, the circuitry may not lock onto the incoming clock, which
generates an erroneous clock within the device. The clock generated by
the ClockLock and ClockBoost circuitry must also meet certain
specifications. If the incoming clock meets these requirements during
configuration, the ClockLock and ClockBoost circuitry will lock onto the
clock during configuration. The circuit will be ready for use immediately
after configuration. Figure 31 illustrates the incoming and generated clock
specifications.
Figure 31. Specifications for the Incoming & Generated Clocks
The t
I
parameter refers to the nominal input clock period; the t
O
parameter refers to the
nominal output clock period.
Table 113. EPF10K250A Device External Bidirectional Timing Parameters
Note (1)
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
t
INSUBIDIR
t
INHBIDIR
t
OUTCOBIDIR
t
XZBIDIR
t
ZXBIDIR
9.3
0.0
2.0
10.6
0.0
2.0
12.7
0.0
2.0
ns
ns
ns
ns
ns
8.0
10.8
10.8
8.9
12.2
12.2
10.4
14.2
14.2
t
R
t
F
t
CLK1
t
INDUTY
t
I
±
f
CLKDEV
t
I
t
I
±
t
INCLKSTB
t
OUTDUTY
t
O
t
O +
t
JITTER
t
O –
t
JITTER
Input
Clock
ClockLock-
Generated
Clock
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