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參數資料
| 型號： | ARM60 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | Low Power General Purpose 32-Bit RISC Microprocessor(低功耗通用32位精簡指令集微處理器) |
| 中文描述： | 低功耗通用32位RISC微處理器（低功耗通用32位精簡指令集微處理器） |
| 文件頁數： | 82/121頁 |
| 文件大?。?/td> | 1217K |
| 代理商： | ARM60 |
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P60ARM-B
78
7.4 Load register
The first cycle of a load register instruction performs the address calculation. The data is fetched from
memory during the second cycle, and the base register modification is performed during this cycle (if
required). During the third cycle the data is transferred to the destination register, and external memory is
unused. This third cycle may normally be merged with the following prefetch to form one memory N-cycle.
The cycle timings are shown below in
Table 10: Load Register Instruction Cycle Operations
.
Either the base or the destination (or both) may be the PC, and the prefetch sequence will be changed if the
PC is affected by the instruction.
The data fetch may abort, and in this case the destination modification is prevented. In addition, if the
processor is configured for Early
Abort, the base register write-back is also prevented.
Cycle
Address
nBW
nRW
Data
nMREQ
SEQ
nOPC
normal
1
pc+8
1
0
(pc+8)
0
0
0
2
alu
b/w
0
(alu)
1
0
1
3
pc+12
1
0
-
0
1
1
pc+12
dest=pc
1
pc+8
1
0
(pc+8)
0
0
0
2
alu
b/w
0
pc’
1
0
1
3
pc+12
1
0
-
0
0
1
4
pc’
1
0
(pc’)
0
1
0
5
pc’+4
1
0
(pc’+4)
0
1
0
pc’+8
Table 10: Load Register Instruction Cycle Operations
相關PDF資料 |
PDF描述 |
|---|---|
| ARM610 | General Purpose 32-Bit Microprocessor with 4kByte Cache,Write Buffer and Memory Management Unit(通用32位微處理器（帶4K字節(jié)緩存，寫緩沖器和存儲器管理單元）) |
| ARRAYS | NIGHT VISION H.V. RECTIFIER DIODES & ARRAYS |
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| AR2540 | 40A GLASS PASSIVATED AVALANCHE BUTTON DIODE |
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相關代理商/技術參數 |
參數描述 |
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