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參數(shù)資料
| 型號(hào)： | ADV7152 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | CMOS 220 MHz True-Color Graphics Triple 10-Bit Video RAM-DAC(三通道,10位視頻RAM-D/A轉(zhuǎn)換器) |
| 中文描述： | 220兆赫的CMOS真彩色圖形三路10位顯存，數(shù)模轉(zhuǎn)換器（三通道，10位視頻RAM的的D / A轉(zhuǎn)換器） |
| 文件頁數(shù)： | 28/32頁 |
| 文件大小： | 322K |
| 代理商： | ADV7152 |
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ADV7152
–5–
REV. B
PIXEL INPUT
DATA*
CLOCK
LOADOUT
LOADIN
ANALOG
OUTPUT
DATA
t
10
AN
BN
AN+1
BN+1
AN-1
BN-1
AN+2
BN+2
AN BN
AN+1BN+1
AN+2BN+2
DIGITAL
INPUT TO ANALOG
OUTPUT
PIPELINE
t
PD
*INCLUDES PIXEL DATA (R0–R7, G0–G7, B0–B7); PALETTE SELECT INPUTS (PS0-PS1); SYNC; BLANK
IOR, IOR
IOG, IOG
IOB, IOB
I
PLL, SYNCOUT
Figure 4. Pixel Input to Analog Output Pipeline with Minimum LOADOUT to LOADIN Delay (2:1 Multiplex Mode)
PIXEL INPUT
DATA*
CLOCK
LOADOUT
LOADIN
ANALOG
OUTPUT
DATA
*INCLUDES PIXEL DATA (R0–R7, G0–G7, B0–B7); PALETTE SELECT INPUTS (PS0–PS1); SYNC; BLANK
DIGITAL
INPUT
TO ANALOG
OUTPUT
PIPELINE
AN BN
AN+1BN+1
AN+2BN+2
AN
BN
AN+1
BN+1
AN-1
BN-1
AN+2
BN+2
t
PD
τ
τ- t
11
IOR, IOR
IOG, IOG
IOB, IOB
I
PLL, SYNCOUT
Figure 5. Pixel Input to Analog Output Pipeline with Maximum LOADOUT to LOADIN Delay (2:1 Multiplex Mode)
t
12
CLOCK
PRGCKOUT
(CLOCK/4)
PRGCKOUT
(CLOCK/8)
PRGCKOUT
(CLOCK/16)
PRGCKOUT
(CLOCK/32)
*INLCUDES PIXEL DATA (R0-R7, G0-G7, B0-B7); PALETTE SELECT INPUTS (PS0-PS1); SYNC; BLANK
Figure 6. Pixel Clock Input vs. Programmable Clock Output (PRGCKOUT)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AE101SD1CQ | TOGGLE SWITCH, SPDT, LATCHED, 2A, 30VDC, THROUGH HOLE-STRAIGHT |
| AE105E11A35SD | 13 CONTACT(S), ALUMINUM ALLOY, FEMALE, MIL SERIES CONNECTOR, CRIMP, RECEPTACLE |
| AE105E11A35S | 13 CONTACT(S), ALUMINUM ALLOY, FEMALE, MIL SERIES CONNECTOR, CRIMP, RECEPTACLE |
| AE105E11A4PA | 4 CONTACT(S), ALUMINUM ALLOY, MALE, MIL SERIES CONNECTOR, CRIMP, RECEPTACLE |
| AE105E11A4PB | 4 CONTACT(S), ALUMINUM ALLOY, MALE, MIL SERIES CONNECTOR, CRIMP, RECEPTACLE |
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參數(shù)描述 |
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