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參數(shù)資料
| 型號： | ADUC7036DCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 21/132頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 96K FLASH DUAL 48LFCSP |
| 標準包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 連通性： | LIN，SPI，UART/USART |
| 外圍設(shè)備： | PSM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 9 |
| 程序存儲器容量： | 96KB（48K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1.5K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 2x16b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 115°C |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 包裝： | 托盤 |
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ADuC7036
Rev. C | Page 117 of 132
LIN Hardware Synchronization Status Register
Name: LHSSTA
Address: 0xFFFF0780
Default Value: 0x00000000
Access: Read only
Function: This LHS status register is a 32-bit register whose bits reflect the current operating status of the LIN interface.
Table 92. LHSSTA MMR Bit Designations
Bit
Description
31 to 7
Reserved. These read only bits are reserved for future use.
6
Rising edge detected (BSD mode only).
Set to 1 by hardware to indicate a rising edge has been detected on the BSD bus.
Cleared to 0 after user code reads the LHSSTA MMR.
5
LHS reset complete flag.
Set to 1 by hardware to indicate an LHS reset command has completed successfully.
Cleared to 0 after user code reads the LHSSTA MMR.
4
Break field error.
Set to 1 by hardware and generates an LHS interrupt (IRQEN[7]) when the 12-bit break timer (LHSVAL1) register
overflows to indicate the LIN bus has stayed low too long, thus indicating a possible LIN bus error.
Cleared to 0 after user code reads the LHSSTA MMR.
3
LHS compare interrupt.
Set to 1 by hardware when the value in LHSVAL0 (LIN synchronization bit timer) equals the value in the LHSCMP register.
Cleared to 0 after user code reads the LHSSTA MMR.
2
Stop condition interrupt.
Set to 1 by hardware when a stop condition is detected.
Cleared to 0 after user code reads LHSSTA MMR.
1
Start condition interrupt.
Set to 1 by hardware when a start condition is detected.
Cleared to 0 after user code reads LHSSTA MMR.
0
Break timer compare interrupt.
Set to 1 by hardware when a valid LIN break condition is detected. A LIN break condition is generated when the LIN
break timer value reaches the break timer compare value (see the LHSVAL1 in the LIN Hardware Synchronization Break
Timer1 Register section for more information).
Cleared to 0 after user code reads the LHSSTA MMR.
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PDF描述 |
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