參數(shù)資料
型號： AD9522-1/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 2/84頁
文件大小： 0K
描述： BOARD EVAL FOR AD9522-1 CLK GEN
設(shè)計(jì)資源： AD9522 Eval Board Schematic
AD9522 BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘發(fā)生器
嵌入式： 否
已用 IC / 零件： AD9522-1
主要屬性： 12 LVDS/24 CMOS 輸出，2.4 GHz VCO
次要屬性： I²C & SPI 接口
已供物品： 板
AD9522-1
Rev. 0 | Page 10 of 84
CLOCK OUTPUT ABSOLUTE PHASE NOISE (INTERNAL VCO USED)
Table 7.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVDS ABSOLUTE PHASE NOISE
Internal VCO; VCO divider = 4; LVDS output and for
loop bandwidths < 1 kHz
VCO = 2650 MHz; Output = 662.5 MHz
@ 1 kHz Offset
59
dBc/Hz
@ 10 kHz Offset
90
dBc/Hz
@ 100 kHz Offset
116
dBc/Hz
@ 1 MHz Offset
134
dBc/Hz
@ 10 MHz Offset
147
dBc/Hz
@ 40 MHz Offset
150
dBc/Hz
VCO = 2460 MHz; Output = 615 MHz
@ 1 kHz Offset
62
dBc/Hz
@ 10 kHz Offset
92
dBc/Hz
@ 100 kHz Offset
118
dBc/Hz
@ 1 MHz Offset
136
dBc/Hz
@ 10 MHz Offset
149
dBc/Hz
@ 40 MHz Offset
151
dBc/Hz
VCO = 2270 MHz; Output = 567.5 MHz
@ 1 kHz Offset
65
dBc/Hz
@ 10 kHz Offset
95
dBc/Hz
@ 100 kHz Offset
121
dBc/Hz
@ 1 MHz Offset
138
dBc/Hz
@ 10 MHz Offset
149
dBc/Hz
@ 40 MHz Offset
151
dBc/Hz
CLOCK OUTPUT ABSOLUTE TIME JITTER (CLOCK GENERATION USING INTERNAL VCO)
Table 8.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVDS OUTPUT ABSOLUTE TIME JITTER
Application example based on a typical
setup where the reference source is
clean, so a wider PLL loop bandwidth is
used; reference = 15.36 MHz; R DIV = 1
VCO = 2458 MHz; LVDS = 245.76 MHz; PLL LBW = 55 kHz
158
fs rms
Integration BW = 200 kHz to 10 MHz
323
fs rms
Integration BW = 12 kHz to 20 MHz
VCO = 2458 MHz; LVDS = 122.88 MHz; PLL LBW = 55 kHz
162
fs rms
Integration BW = 200 kHz to 10 MHz
323
fs rms
Integration BW = 12 kHz to 20 MHz
VCO = 2458 MHz; LVDS = 61.44 MHz; PLL LBW = 55 kHz
210
fs rms
Integration BW = 200 kHz to 10 MHz
371
fs rms
Integration BW = 12 kHz to 20 MHz
CLOCK OUTPUT ABSOLUTE TIME JITTER (CLOCK CLEANUP USING INTERNAL VCO)
Table 9.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVDS OUTPUT ABSOLUTE TIME JITTER
Application example based on a typical
setup where the reference source is jittery,
so a narrower PLL loop bandwidth is used;
reference = 19.44 MHz; R DIV = 162
VCO = 2333 MHz; LVDS = 155.52 MHz; PLL LBW = 1.8 kHz
491
fs rms
Integration BW = 12 kHz to 20 MHz
VCO = 2458 MHz; LVDS = 122.88 MHz; PLL LBW = 1.8 kHz
554
fs rms
Integration BW = 12 kHz to 20 MHz
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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AD9522-2BCPZ 功能描述:IC CLOCK GEN 2.2GHZ VCO 64LFCSP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:2,000 系列:- 類型:PLL 時(shí)鐘發(fā)生器 PLL:帶旁路 輸入:LVCMOS，LVPECL 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:2:11 差分 - 輸入:輸出:是/無 頻率 - 最大:240MHz 除法器/乘法器:是/無 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應(yīng)商設(shè)備封裝:32-TQFP（7x7） 包裝:帶卷 (TR)
AD9522-2BCPZ-REEL7 功能描述:IC CLOCK GEN 2.2GHZ VCO 64LFCSP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:2,000 系列:- 類型:PLL 時(shí)鐘發(fā)生器 PLL:帶旁路 輸入:LVCMOS，LVPECL 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:2:11 差分 - 輸入:輸出:是/無 頻率 - 最大:240MHz 除法器/乘法器:是/無 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應(yīng)商設(shè)備封裝:32-TQFP（7x7） 包裝:帶卷 (TR)
AD9522-3 制造商:AD 制造商全稱:Analog Devices 功能描述:12 LVDS/24 CMOS Output Clock Generator with Integrated 2 GHz VCO
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