參數(shù)資料
型號(hào)： 84221
英文描述： 84221 Quad 10/100 Mbps TX/FX/10BT (PHY) manual 1/99
中文描述： 84221四10/100 Mbps的TX/FX/10BT（PHY）的手冊(cè)1 / 99
文件頁(yè)數(shù)： 9/70頁(yè)
文件大小： 1017K
代理商： 84221
MD400184/A
9
84221
Table 1. AutoNegotiation, Speed & Duplex Mode Combinations
Input Pins
Mode Selected
Aneg
Speed[3:0]
Duplx [3:0]
Auto-
neg
Forced
Modes
[Note 2]
Advertised
Capabilities
Speed
DPLX
Speed
DPLX
0
0000
0000
Off
10
Half
na
na
0
0000
1111
Off
10
Full
na
na
0
1111
0000
Off
100
Half
na
na
0
1111
1111
Off
100
Full
na
na
1
0000
0000
On
na
na
10
Half
1
0000
1111
On
na
na
10
Half/Full
1
1111
0000
On
na
na
10/100
Half/Full
[3]
1
1111
1111
On
na
na
10/100
Half
Note 1: The single ANEG pin applies to all four channels. The four Speed and DPLX apply to each individual channel.
The pins above are shown for all four channels, but each channel can be individually configured for SPEED and DPLX by
appropriately setting the pin for that channel.
Note 2: Forced Modes assume that registers 0 and 4 are at default values.
Note 3: the 84221 can be either controlled through the software or through the hardware. If the device needs to be con-
trolled through the software (Registers 0 to 4), then these seven pins (ANEG, Speed[3:0] , Duplx[3:0]) have to be tied to
their default values of 1, 1111, and 0000 respectively.
相關(guān)PDF資料
PDF描述
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