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參數(shù)資料
| 型號： | XC4028XLA |
| 廠商： | Xilinx, Inc. |
| 英文描述： | Field Programmable Gate Arrays(現(xiàn)場可編程門陣列) |
| 中文描述： | 現(xiàn)場可編程門陣列（現(xiàn)場可編程門陣列） |
| 文件頁數(shù)： | 4/16頁 |
| 文件大小： | 72K |
| 代理商： | XC4028XLA |
R
XC4000XLA/XV FIeld Programmable Gate Arrays
6-174
DS004 (v. 1.3) October 4, 1999 - Product Specification
Delay Via Global Early BUFGEs 1, 2, 5, 6 to IOB Clock
Delay Via Global Early BUFGEs 3, 4, 7, 8 to IOB Clock
Speed Grade
Symbol
T
GE
All
Min
0.2
0.2
0.2
0.3
0.3
0.3
0.3
0.3
-09
Max
1.7
1.9
2.1
2.4
2.7
3.0
3.3
3.7
Preliminary
-08
Max
1.5
1.7
1.9
2.2
2.4
2.7
3.0
3.3
-07
Max
1.3
1.5
1.7
1.9
2.2
2.4
2.7
3.0
Units
Description
Device
XC4013XLA
XC4020XLA
XC4028XLA
XC4036XLA
XC4044XLA
XC4052XLA
XC4062XLA
XC4085XLA
Delay from pad through Global Early (GE) clock buffer to
any IOB clock input for BUFGEs 1, 2, 5, and 6.
ns
ns
ns
ns
ns
ns
ns
ns
Speed Grade
Symbol
T
GE
All
Min
0.5
0.6
0.6
0.7
0.8
0.8
0.9
1.0
-09
Max
2.5
2.7
2.9
3.1
3.3
3.6
3.8
4.3
Preliminary
-08
Max
2.2
2.4
2.5
2.7
2.9
3.1
3.4
3.8
-07
Max
1.9
2.1
2.3
2.4
2.6
2.8
3.0
3.4
Units
Description
Device
XC4013XLA
XC4020XLA
XC4028XLA
XC4036XLA
XC4044XLA
XC4052XLA
XC4062XLA
XC4085XLA
Delay from pad through Global Early (GE) clock buffer to
any IOB clock input for BUFGEs 3, 4, 7, and 8.
ns
ns
ns
ns
ns
ns
ns
ns
相關PDF資料 |
PDF描述 |
|---|---|
| XC4044XLA-08HQ240I | XC4000XLA/XV Field Programmable Gate Arrays |
| XC4044XL | XC4000E and XC4000X Series Field Programmable Gate Arrays |
| XC4044XLA | XC4000XLA/XV Field Programmable Gate Arrays |
| XC40250XV | XC4000XLA/XV Field Programmable Gate Arrays |
| XC40150XV | XC4000XLA/XV Field Programmable Gate Arrays |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XC4028XLA-07HQ240C | 制造商:Xilinx 功能描述: |
| XC4028XLA-08BG352C0314 | 制造商:Xilinx 功能描述: |
| XC4028XLA-08BG352C0716 | 制造商:Xilinx 功能描述: |
| XC4028XLA08HQ208C | 制造商:Xilinx 功能描述: |
| XC4028XLA-08HQ208C | 制造商:Xilinx 功能描述: |
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