參數(shù)資料
型號： XC4028XLA
廠商： Xilinx, Inc.
英文描述： Field Programmable Gate Arrays(現(xiàn)場可編程門陣列)
中文描述： 現(xiàn)場可編程門陣列（現(xiàn)場可編程門陣列）
文件頁數(shù)： 11/16頁
文件大小： 72K
代理商： XC4028XLA
R
DS004 (v. 1.3) October 4, 1999 - Product Specification
6-181
XC4000XLA/XV FIeld Programmable Gate Arrays
6
FastCLK Input Set-Up and Hold for BUFNW, BUFSW, BUFNE, & BUFSE
Speed Grade
Description
Input Setup and Hold Time Relative to FastCLK Input Signal
No Delay
FastCLK and IFF
-09
Min
-08
Min
-07
Min
Units
Symbol
Device
XC4013XLA
XC4020XLA
XC4028XLA
XC4036XLA
XC4044XLA
XC4052XLA
XC4062XLA
XC4085XLA
XC4013XLA
XC4020XLA
XC4028XLA
XC4036XLA
XC4044XLA
XC4052XLA
XC4062XLA
XC4085XLA
XC4013XLA
XC4020XLA
XC4028XLA
XC4036XLA
XC4044XLA
XC4052XLA
XC4062XLA
XC4085XLA
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3.5 / 0.6
3.8 / 0.4
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4.3 / 0.0
4.6 / 0.0
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3.6 / 0.1
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4.0 / 0.0
4.3 / 0.0
4.6 / 0.0
5.0 / 0.0
5.8 / 0.0
Preliminary
0.0 / 2.6
0.0 / 2.7
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5.5 / 0.0
ns
ns
ns
ns
ns
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ns
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T
PSFN
/T
PHFN
Partial Delay
FastCLK and IFF
T
PSFP
T
PHFP
Full Delay
FastCLK and IFF
T
PSFD
/T
PHFD
IFF = Input Flip-Flop or Latch
Note:
Setup time is measured with the fastest route and the lightest load. Hold time is measured using the furthest distance and a
reference load of one clock pin per two IOBs. Use the static timing analyzer (TRCE)) to determine the setup and hold times
under given design conditions.
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