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參數(shù)資料
| 型號(hào)： | VDP3130Y |
| 廠商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 英文描述： | Video Processor Family |
| 中文描述： | 視頻處理器系列 |
| 文件頁(yè)數(shù)： | 45/76頁(yè) |
| 文件大?。?/td> | 1770K |
| 代理商： | VDP3130Y |
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ADVANCE INFORMATION
VDP 313xY
Micronas
45
Color Processing
30
Saturation control
bit[11:0]
0...4094 (2070 corresponds to 100% saturation)
4095
disabled (test mode only)
2070
ACC_SAT
17A
bit[10:0]
0...2047 CR-attenuation
bit[11]
0/1
disable/enable CR-attenuation
1591
o
CR_ATT
CR_ATT_ENA
39
bit[10:0]
0...2047 amplitude killer level (0: killer disabled)
bit[11]
0/1
disable/enable chroma ADC
25
0
KILVL
3A
amplitude killer hysteresis
5
KILHY
DC
NTSC tint angle,
±
512 =
±π
/4
0
TINT
DVCO
F8
crystal oscillator center frequency adjust,
2048...2047
720
DVCO
F9
crystal oscillator center frequency adjustment value for line lock
mode,true adjust value is DVCO - ADJUST.
For factory crystal alignment, using standard video signal:
set DVCO = 0, set lock mode, read crystal offset from ADJUST
register and use negative value for initial center frequency adjust-
ment via DVCO.
read only
ADJUST
F7
crystal oscillator line-locked mode, lock command/status
write: 100
enable lock
disable lock
unlocked
locked
0
read: 0
>2047
0
XLCK
B5
crystal oscillator line-locked mode, autolock feature. If autolock is
enabled, crystal oscillator locking is started automatically.
bit[11:0]
threshold; 0: autolock off
400
AUTOLOCK
Table 2
–
6:
Control Registers of the Fast Processor for control of the video frontend functions
default values are initializied at reset
FP Sub-
address
(hex)
Function
Default
Name
(hex)
相關(guān)PDF資料 |
PDF描述 |
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