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參數(shù)資料
| 型號： | VDP3108 |
| 廠商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 英文描述： | Single-Chip Video Processor |
| 中文描述： | 單芯片視頻處理器 |
| 文件頁數(shù)： | 30/61頁 |
| 文件大?。?/td> | 2638K |
| 代理商： | VDP3108 |
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VDP 3108
ADVANCE INFORMATION
MICRONAS INTERMETALL
30
Name
Default
Function
Mode
Number
of bits
I
2
C Sub
address
57
5b
5f
9
w v
PLL2/3 filter coefficients, refer to section ‘horizontal deflection’
2
2
2
PKP3
PKP2
PKI2
15
16
w/r d
horizontal drive control register
bit [5:0]
0..63
bit [6]
0/1
bit [7]
0/1
bit [8]
0
bit [9]
0/1
bit [10]
0/1
bit [11]
0/1
bit [12]
0/1
bit [13]
0/1
bit [14]
0/1
bit [15,12]
00
01
10
11
horizontal drive pulse duration in
μ
sec
disable/enable horizontal pll loops
1: gate HOUT off during flyback
enable/disable ultra black blanking
force/enable blanking after reset
enable/disable analog RGB clamping
disable/enable composite sync(ref.bit[15])
enable/disable vertical protection
bypass/active display clock skew
function of CSIO pin
composite sync signal output
25 Hz output (field1/field2 signal)
no interlace (field 2), output = 0
1 MHz h–drive clock
32
HDRV
EHPLL
EFLB
DUBL
EBL
DCRGB
DVPR
CSKEW
CSYNC
TEST REGISTER
39
8
w/r
Main Test Register
3f
8
w/r
Front End, Luma1
3e
8
w/r
Front End, Luma2
3d
8
w/r
Front End, Luma3
2f
8
w/r
Front End, Chroma1
2e
8
w/r
Front End, Chroma2
2a
16
w/r
Display 1
2b
16
w/r
Display 2
2c
8
w/r
Display 3
3a
8
w/r
FP
3b
16
w/r
Display Processor Control
2d
16
w/r
Deflection
3c
8
w/r
Analog Backend
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VDP3130Y | Video Processor Family |
| VDP31XXB | Video Processor Family |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| VDP3108B | 制造商:MICRONAS 制造商全稱:MICRONAS 功能描述:Video Processor Family |
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