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參數(shù)資料
| 型號(hào)： | TSPC860 |
| 廠商： | Atmel Corp. |
| 英文描述： | Integrated Communication Processor |
| 中文描述： | 綜合通信處理器 |
| 文件頁數(shù)： | 50/93頁 |
| 文件大?。?/td> | 1601K |
| 代理商： | TSPC860 |
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50
TSPC860 [Preliminary]
2129B–HIREL–12/04
Figure 27.
Interrupt Detection Timing for External Level Sensitive Lines
Figure 28.
Interrupt Detection Timing for External Edge Sensitive Lines
Notes:
1. PSST = 1. Otherwise add PSST times cycle time.
2. PSHT = 1. Otherwise add PSHT times cycle time.
CLKOUT
IRQx
I39
I40
CLKOUT
IRQx
I41
I42
I43
I43
Table 9.
PCMCIA Timing
Num
Characteristic
33 MHz
40 MHz
50 MHz
66 MHz
Unit
Min
Max
Min
Max
Min
Max
Min
Max
P44
A(0:31), REG valid to PCMCIA Strobe
asserted
(1)
20.73
–
16.75
–
13
–
9.36
–
ns
P45
A(0:31), REG valid to ALE negation
(1)
28.30
–
23
–
18
–
13.15
–
ns
P46
CLKOUT to REG valid
7.58
15.58
6.25
14.25
5
13
3.79
11.84
ns
P47
CLKOUT to REG Invalid
8.58
–
7.25
–
6
–
4.84
–
ns
P48
CLKOUT to CE1, CE2 asserted
7.58
15.58
6.25
14.25
5
13
3.79
11.84
P49
CLKOUT to CE1, CE2 negated
7.58
15.58
6.25
14.25
5
13
3.79
11.84
ns
P50
CLKOUT to PCOE, IORD, PCWE, IOWR
assert time
11
11
ns
P51
CLKOUT to PCOE, IORD, PCWE, IOWR
negate time
2
11
2
11
ns
P52
CLKOUT to ALE assert time
7.58
15.58
6.25
14.25
5
13
3.79
11.04
ns
P53
CLKOUT to ALE negate time
–
15.58
–
14.25
–
13
–
11.84
ns
P54
PCWE, IOWR negated to D(0:31) invalid
(1)
5.58
–
4.25
–
3
–
1.79
–
ns
P55
WAITA and WAITB valid to CLKOUT rising
edge
(1)
8
–
8
–
8
–
8
–
ns
P56
CLKOUT rising edge to WAITA and WAITB
invalid
(1)
2
–
2
–
2
–
2
–
ns
相關(guān)PDF資料 |
PDF描述 |
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