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參數(shù)資料
| 型號： | TMX320DM6443ZWT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System-on-Chip |
| 中文描述： | 數(shù)字媒體系統(tǒng)片上 |
| 文件頁數(shù)： | 142/221頁 |
| 文件大?。?/td> | 1582K |
| 代理商： | TMX320DM6443ZWT |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁當前第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁
www.ti.com
6.11.2 ATA/CF Electrical Data/Timing
TMS320DM6443
Digital Media System-on-Chip
SPRS282E–DECEMBER 2005–REVISED MARCH 2007
All ATA/CF AC timing data described in
Section 6.11.2.1
–
Section 6.11.2.3
is provided at the DM6443
device pins. For more details, see
Section 6.1
,
Parameter Information
.
The AC timing specifications described in
Section 6.11.2.1
–
Section 6.11.2.3
assume correct configuration
of the ATA/CF memory-mapped control registers for the selected ATA/CF frequency of operation.
6.11.2.1
ATA/CF PIO Data Transfer AC Timing
Table 6-39. Timings for ATA/CF Module — PIO Data Transfer
(1)(2)
(see
Figure 6-26
)
-594
MIN
NO.
UNIT
MODE
0-4
(3)
0-4
(3)
0-4
(3)
0-2
3-4
(3)
MAX
1
2
3
t
0
t
1
t
2
Cycle time
Address valid to DIOW/ DIOR setup
DIOW/ DIOR pulse duration low
(DATSTB + DATRCVR + 2)P -0.5
12P - 1.6
(DATSTB + 1)P - 1
–
(DATRCVR + 1)P - 1
ns
ns
ns
ns
ns
4
t
2i
DIOW/DIOR recovery time, pulse duration high
DIOW data setup time, DD[15:0] valid before
DIOW rising edge
DIOW data hold time, DD[15:0] valid after DIOW
rising edge
5
t
3
0-4
(3)
(DATSTB + 1)P
ns
6
t
4
0-4
(3)
(HWNHLD + 1)P + 1
ns
0
1
50
35
20
ns
ns
ns
DIOR data setup time, DD[15:0] valid before DIOR
rising edge
7
t
5
2-4
(3)
DIOR data hold time, DD[15:0] valid after DIOR
rising edge
Output data 3-state, DD[15:0] 3-state after DIOR
rising edge
DIOW/DIOR to address valid hold
Read data setup time, DD[15:0] valid before
IORDY active
IORDY setup
IORDY pulse width
IORDY assertion to release
8
t
6
0-4
(3)
5
ns
9
t
6Z
0-4
(3)
30
ns
10
t
9
0-4
(3)
(HWNHLD + 1)P - 2.1
ns
11
t
RD
0-4
(3)
0
ns
12
13
14
t
A
t
B
t
C
0-4
(3)(4)
0-4
(3)
0-4
(3)
35
ns
ns
ns
1250
5
(1)
(2)
P = SYSCLK5 period, in ns, for ATA. For example, when running the DSP CPU at 594 MHz, use P = 10.1 ns.
DATSTB equals the value programmed in the DATSTBxP bit field in the DATSTB register. DATRCVR equals the value programmed in
the DATRCVRxP bit field in the DATRCVR register. HWNHLD equals the value programmed in the HWNHLDxP bit field in the
MISCCTL register. For more detailed information, see the
TMS320DM644x DMSoC ATA Controller User's Guide
(literature number
SPRUE21
).
The sustained throughput for PIO modes 3 and 4 is limited to the throughput equivalent of PIO mode 2. For more detailed information,
see the
TMS320DM644x DMSoC ATA Controller User's Guide
(literature number
SPRUE21
).
The t
parameter must be met only when the IORDY timer is enabled to allow a device to insert wait states during a transaction. In order
to meet the t
A
parameter, a minimum frequency for SYSCLK5 is specified for each PIO as follows:
PIO mode 0, MIN frequency = 15 MHz
PIO mode 1, MIN frequency = 22 MHz
PIO mode 2, MIN frequency = 31 MHz
PIO mode 3, MIN frequency = 45 MHz
PIO mode 4, MIN frequency = 57 MHz
(3)
(4)
Peripheral and Electrical Specifications
142
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