參數(shù)資料
型號(hào)： TMS320VC5409PGE-100
元件分類(lèi)： 數(shù)字信號(hào)處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 59/78頁(yè)
文件大?。?/td> 1018K
代理商： TMS320VC5409PGE-100
TMS320VC5409
FIXED-POINT DIGITAL SIGNAL PROCESSOR
SPRS082C – APRIL 1999 – REVISED MARCH 2000
59
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
multichannel buffered serial port timing
timing requirements for the McBSP
[H=0.5t
c(CO)
] (see Figure 30 and Figure 31)
MIN
MAX
UNIT
tc(BCKRX)
tw(BCKRX)
Cycle time, BCLKR/X
BCLKR/X ext
4H
ns
Pulse duration, BCLKR/X or BCLKR/X high
BCLKR/X ext
2H–1
ns
th(BCKRL-BFRH)
Hold time external BFSR high after BCLKR low
Hold time, external BFSR high after BCLKR low
BCLKR int
0
ns
BCLKR ext
4
th(BCKRL-BDRV)
Hold time BDR valid after BCLKR low
Hold time, BDR valid after BCLKR low
BCLKR int
0
ns
BCLKR ext
4
th(BCKXL-BFXH)
Hold time external BFSX high after BCLKX low
Hold time, external BFSX high after BCLKX low
BCLKX int
0
ns
BCLKX ext
4
tsu(BFRH-BCKRL)
Setup time external BFSR high before BCLKR low
Setup time, external BFSR high before BCLKR low
BCLKR int
7
ns
BCLKR ext
2
tsu(BDRV-BCKRL)
Setup time BDR valid before BCLKR low
Setup time, BDR valid before BCLKR low
BCLKR int
7
ns
BCLKR ext
2
tsu(BFXH-BCKXL)
Setup time external BFSX high before BCLKX low
Setup time, external BFSX high before BCLKX low
BCLKX int
7
ns
BCLKX ext
2
tr(BCKRX)
tf(BCKRX)
Polarity bits CLKRP = CLKXP = FSRP = FSXP = 0. If the polarity of any of the signals is inverted, then the timing references of
that signal are
also inverted.
Rise time, BCKR/X
BCLKR/X ext
8
ns
Fall time, BCKR/X
BCLKR/X ext
8
ns
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PDF描述
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