參數(shù)資料
型號(hào)： TMS320VC5409PGE-100
元件分類： 數(shù)字信號(hào)處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 43/78頁(yè)
文件大?。?/td> 1018K
代理商： TMS320VC5409PGE-100
TMS320VC5409
FIXED-POINT DIGITAL SIGNAL PROCESSOR
SPRS082C – APRIL 1999 – REVISED MARCH 2000
43
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
memory and parallel I/O interface timing
switching characteristics over recommended operating conditions for a memory read
(MSTRB = 0)
(see Figure 15)
PARAMETER
’5409-80,-100
MIN
UNIT
MAX
td(CLKL-A)
td(CLKH-A)
td(CLKL-MSL)
td(CLKL-MSH)
th(CLKL-A)R
th(CLKH-A)R
Address, PS, and DS timings are all included in timings referenced as address.
In the case of a memory read preceded by a memory read
§In the case of a memory read preceded by a memory write
Delay time, CLKOUT low to address valid
Delay time, CLKOUT high (transition) to address valid§
0
3
ns
0
3
ns
Delay time, CLKOUT low to MSTRB low
0
3
ns
Delay time, CLKOUT low to MSTRB high
Hold time, address valid after CLKOUT low
Hold time, address valid after CLKOUT high§
0
3
ns
0
3
ns
0
3
ns
timing requirements for a memory read (MSTRB = 0) [H = 0.5 t
c(CO)
]
(see Figure 15)
’5409-80,-100
MIN
UNIT
MAX
2H–10
2H–10
ta(A)M
ta(MSTRBL)
tsu(D)R
th(D)R
th(A-D)R
th(D)MSTRBH
Address, PS, and DS timings are all included in timings referenced as address.
This access timing reflects a zero wait-state timing.
Access time, read data access from address valid
ns
Access time, read data access from MSTRB low
ns
Setup time, read data before CLKOUT low
8
ns
Hold time, read data after CLKOUT low
0
ns
Hold time, read data after address invalid
0
ns
Hold time, read data after MSTRB high
1
ns
相關(guān)PDF資料
PDF描述
TMS320VC5409GGU-100 16-Bit Digital Signal Processor
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SE370C758BJNT 8-BIT MICROCONTROLLER
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參數(shù)描述
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