參數(shù)資料
型號： TMS320VC5409PGE-100
元件分類： 數(shù)字信號處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號處理器
文件頁數(shù)： 49/78頁
文件大?。?/td> 1018K
代理商： TMS320VC5409PGE-100
TMS320VC5409
FIXED-POINT DIGITAL SIGNAL PROCESSOR
SPRS082C – APRIL 1999 – REVISED MARCH 2000
49
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
ready timing for externally generated wait states
timing requirements for externally generated wait states [H = 0.5 t
c(CO)
]
(see Figure 19, Figure 20,
Figure 21, and Figure 22)
’5409-80,-100
MIN
7
UNIT
MAX
tsu(RDY)
th(RDY)
tv(RDY)MSTRB
th(RDY)MSTRB
tv(RDY)IOSTRB
th(RDY)IOSTRB
tv(MSCL)
tv(MSCH)
The hardware wait states can be used only in conjunction with the software wait states to extend the bus cycles. To generate wait states using
READY, at least two software wait states must be programmed.
These timings are included for reference only. The critical timings for READY are those referenced to CLKOUT.
Setup time, READY before CLKOUT low
ns
Hold time, READY after CLKOUT low
Valid time, READY after MSTRB low
Hold time, READY after MSTRB low
Valid time, READY after IOSTRB low
Hold time, READY after IOSTRB low
0
ns
4H–9
ns
4H
ns
5H–9
ns
5H
ns
Valid time, MSC low after CLKOUT low
0
3
ns
Valid time, MSC high after CLKOUT low
0
3
ns
MSC
MSTRB
READY
A[22:0]
CLKOUT
tv(MSCH)
tv(MSCL)
th(RDY)
th(RDY)MSTRB
tv(RDY)MSTRB
Wait State
Generated
by READY
Wait States
Generated Internally
tsu(RDY)
NOTE A: A[22:16] apply to DMA accesses to extended I/O, DATA, PROGRAM memory. The CPU has access to
only
extended
PROGRAM memory.
Figure 19. Memory Read With Externally Generated Wait States
相關(guān)PDF資料
PDF描述
TMS320VC5409GGU-100 16-Bit Digital Signal Processor
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SE370C758BFZT 8-BIT MICROCONTROLLER
SE370C758BJNT 8-BIT MICROCONTROLLER
SE370C759AFZT 8-BIT MICROCONTROLLER
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