- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄381122 > STR912FAW32H6T (意法半導(dǎo)體) ARM966E-S⑩ 16/32-Bit Flash MCU with Ethernet, USB, CAN, AC motor control, 4 timers, ADC, RTC, DMA PDF資料下載
參數(shù)資料
| 型號(hào)： | STR912FAW32H6T |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | ARM966E-S⑩ 16/32-Bit Flash MCU with Ethernet, USB, CAN, AC motor control, 4 timers, ADC, RTC, DMA |
| 中文描述： | ARM966E -虜⑩16/32位閃存微控制器與以太網(wǎng)，USB，加拿大，交流電機(jī)控制，4個(gè)定時(shí)器，模數(shù)轉(zhuǎn)換器，RTC和DMA的 |
| 文件頁(yè)數(shù)： | 85/99頁(yè) |
| 文件大小： | 979K |
| 代理商： | STR912FAW32H6T |
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STR91xFAx32 STR91xFAx42 STR91xFAx44
Electrical characteristics
85/99
7.12.5
SPI electrical characteristics
V
DDQ
= 2.7 - 3.6V, V
DD
= 1.65 - 2V, T
A
= -40 / 85 °C unless otherwise specified.
Table 45.
Figure 29.
SPI slave timing diagram with CPHA=0
SPI electrical characteristics
Symbol
Parameter
Test Conditions
Value
Unit
Typ
Max
f
SCLK
1/t
c(SCLK)
SPI clock frequency
Master
24
MHz
Slave
4
t
r(SCLK)
SPI clock rise and fall times
50pF load
0.1
V/ns
t
f(SCLK)
t
su(SS)
SS setup time
Slave
1
t
PCLK
t
h(SS)
SS hold time
Slave
1
t
w(SCLKH)
t
w(SCLKL)
SCLK high and low time
Master
Slave
1
t
su(MI)
t
su(SI)
Data input setup time
Master
Slave
5
t
h(MI)
t
h(SI)
Data input hold time
Master
Slave
6
t
a(SO)
Data output access time
Slave
6
t
dis(SO)
Data output disable time
Slave
6
t
v(SO)
Data output valid time
Slave (after enable
edge)
6
t
h(SO)
Data output hold time
0
t
v(MO)
Data output valid time
Master (before capture
edge)
0.25
t
h(MO)
Data output hold time
0.25
NSS
INPUT
S
I
CPHA=0
CPOL=0
MOSI
INPUT
MISO
OUTPUT
CPHA=0
CPOL=1
t
c(SCLK)
t
w(SCLKH)
t
w(SCLKL)
t
r(SCLK)
t
f(SCLK)
t
v(SO)
t
a(SO)
t
su(SI)
t
h(SI)
MSB OUT
MSB IN
BIT6 OUT
LSB IN
LSB OUT
t
su(NSS)
t
h(NSS)
t
dis(SO)
t
h(SO)
BIT1 IN
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PDF描述 |
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參數(shù)描述 |
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