參數(shù)資料
型號： STPCE1
英文描述： STPC ELITE DATASHEET / X86 CORE GENERAL PURPOSE PC COMPATIBLE SYSTEM ON CHIP
中文描述： STPC精英部件/ x86內(nèi)核PC兼容的通用目的片上系統(tǒng)
文件頁數(shù)： 31/87頁
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代理商： STPCE1
STRAP OPTION
Release 1.3 - January 29, 2002
31/87
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3.1.4. HCLK STRAP REGISTER CONFIGURATION
HCLK_Strap
Access = 0022h/0023h
Regoffset = 05Fh
7
6
5
4
3
2
1
0
MD3
MD2
MD26
MD25
MD24
Rsv
This register defaults to the values sampled on MD[3:2] and MD[26:24] pins after reset
Bit Number Sampled
Mnemonic
Description
Bits 7-3
MD[3:2] & [26:24]
These bits reflect the values sampled on
MD[3:2]
and
MD[26:24]
pins
respectively and control the Host clock frequency synthesizer, as given
in
Table 3-4
.
Bits 2-0
Rsv
Reserved
Table 3-4. HCLK Frequency
Bit 7
0
0
0
0
0
0
1
1
Bit 6
0
0
0
0
1
1
0
1
Bit 5
0
0
0
0
0
1
0
0
Bit 4
0
0
1
1
0
1
1
0
Bit 3
0
1
0
1
1
0
1
1
HCLK Frequency
25 MHz
50 MHz
60 MHz
66 MHz
75 MHz
82.5 MHz
90 MHz
100 MHz
相關(guān)PDF資料
PDF描述
STPCE1DDBC Microprocessor
STPCE1DDBI Microprocessor
STPCE1HDC Microprocessor
STPCELITE X86 Core General Purpose PC Compatible System - on - Chip
STPCE1EDBI X86 Core General Purpose PC Compatible System - on - Chip
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參數(shù)描述
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