參數(shù)資料
型號(hào)： STE10/100E
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 1 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PQFP128
封裝： 14 X 20 MM, 2.70 MM HEIGHT, PLASTIC, QFP-128
文件頁數(shù)： 31/66頁
文件大小： 396K
代理商： STE10/100E
37/66
STE10/100A
5.4 Descriptors and Buffer Management
The STE10/100A provides receive and transmit descriptors for packet buffering and management.
5.4.1 Receive descriptor
Table 9. Receive Descriptor Table
31
0
Note:
1. Descriptors and receive buffers addresses must be longword aligned
4~2
CMODE
Reports current transceiver operating mode.
000: in auto-negotiation
001: 10Base-T half duplex
010: 100Base-TX half duplex
011: reserved
100: reserved
101: 10Base-T full duplex
110: 100Base-TX full duplex
111: isolation, auto-negotiation disable
000
RO
1
DISMLT
Disable MLT3.
0: the MLT3 encoder and decoder are enabled.
1: the MLT3 encoder and decoder are bypassed.
0
R/W
0
DISCRM
Disable Scramble.
0: the scrambler and de-scrambler is enabled.
1: the scrambler and de-scrambler are disabled.
0
R/W
RDES0
Own
Status
RDES1
---
Control
Buffer2 byte-count
Buffer1 byte-count
RDSE2
Buffer1 address (DW boundary)
RDSE3
Buffer2 address (DW boundary
Table 8. Transceiver registers Descriptions
Bit #
Name
Descriptions
Default Val
RW Type
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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