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參數(shù)資料
| 型號： | SPAK56855BU120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| 封裝： | LQFP-100 |
| 文件頁數(shù)： | 567/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56855BU120 |
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B-140
DSP56F801/803/805/807 User’s Manual
MOTOROLA
Preliminary
Application:
Date:
Programmer:
Sheet
C
B
HI8
HI8 Interface Control Register (ICR)
Bits
Name
Description
7INIT
Initialize
The Initialize bit is used by the host processor to force initialization of the HI8 hardware.
6
HM1
Host Mode Control
5HM0
The Host mode control bits HM0 and HM1 select the Transfer mode of the HI8. HM1 and HM0
enable the DMA mode of operation, or they interrupt a no-Host DMA mode of operation when
HREQ bit in the Host Control Register (HCR) is set.
4
HF1
Host Flag 1
The Host Flag 1 (HF1) bit is used as a general purpose flag for Host-to-DSP communication.
The HF1 bit can be set or cleared by the host processor, but cannot be changed by the DSP
core. The HF1 bit is cleared on DSP reset.
3
HF0
Host Flag 0
The Host Flag 0 (HF0) bit is used as a general purpose flag for Host-to-DSP communication.
The HF0 bit can be set or cleared by the host processor, but cannot be changed by the DSP
core. The HF0 bit is cleared on DSP reset.
2
HLEND
ICR Host Little Endian
This bit allows the HI8 to be accessed by the Host in or Big Endian data order. When the HLEND
bit is set, the HI8 can be accessed by the Host in Little Endian order. The RXH/TXH is located
at address $7 and RXL/TXL at $6. When the HLEND bit is cleared, the HI8 can be accessed by
the Host in Big Endian Host data order. The RXH/TXH is located at address $6 and RXL/TXL
at $7. The HLEND bit is cleared on hardware reset.
1
TREQ
ICR Transmit Request Enable
This bit is used to control the HREQ pin for Host transmit data transfers. In the Interrupt mode,
and the DMA is off, TREQ is used to enable interrupt requests via the external Host Request
(HREQ or HTRQ) pin when the TXDE status bit in the ISR is set. When TREQ is cleared, TXDE
interrupt is disabled.
0
RREQ
Receive Request Enable
This bit is used to control the HREQ pin for Host receive data transfers. In the Interrupt mode
(HDMA off), the RREQ is used to enable interrupt requests via the external Host Request
(HREQ or HRRQ) pin when the Receive Data Register Full (RXDF) status bit in the Interrupt
Status register (ISR) is set. When RREQ is cleared, RXDF interrupts are disabled. When RREQ
is set, the external Host Request HREQ pin or HRRQ is asserted if RXDF is set in interrupt
mode.
5 of 10
HI8 Interface
Control Register
(ICR)
$1FFFD8 + $0
Bits
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
INIT
HM1
HM0
HF1
HF0 HLEND TREQ RREQ
Write
0
RESET
0
000
00
0
denotes Reserved Bits
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| SPAKDSP303GC100 | 制造商:Motorola Inc 功能描述: |
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