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參數(shù)資料
| 型號： | SPAK56855BU120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| 封裝： | LQFP-100 |
| 文件頁數(shù)： | 353/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56855BU120 |
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Servicing the Host Interface
MOTOROLA
Host Interface Eight (HI8)
16-23
Preliminary
16
16.9.2.1 Reserved—Bits 15-8
These bits are reserved or not implemented. They are read as, and written with 0s.
16.9.2.2 Host Command (HC)—Bit 7
This bit is used by the Host Processor to handshake the execution of Host Command
interrupts. Normally, the Host Processor sets HC = 1 to request the Host Command
interrupt from the DSP core. When the Host Command interrupt is acknowledged by the
DSP core the HC bit is cleared by the HI8 hardware. The Host Processor can read the state
of the HC bit to determine when the Host Command has been accepted. After writing HC
= 1 to the CVR, the Host must not write to the CVR again until the HC bit is cleared by the
HI8 hardware. Setting the HC bit causes Host Command pending to be set in the Host
Status Register.
16.9.2.3 CVR Host Vector (HV)—Bits 6–0
These seven bits select the Host Command interrupt offset address in the vector table to be
used by the Host Command interrupt logic. When the Host Command interrupt is
recognized by the DSP interrupt control logic the offset address of the interrupt vector
table taken is 2
× HVI0, 6. The Host can write HC and HV in the same write cycle.
The Host Processor can select any of the 128 possible offset addresses of the interrupt
vector table in the DSP by writing this address divided by 2, and equal to the vector
number, into HV bits. This means the Host Processor can force any of the existing
interrupt handlers, SW interrupts such as ESSI, SCI, IRQA, or IRQB and can use any of
the reserved or otherwise unused interrupt vectors.
16.10 Servicing the Host Interface
The HI8 can be serviced by using one of the following protocols:
Polling
Interrupts
Host DMA
From the Host Processor viewpoint, the service consists of making a data transfer because
this is the only way to reset the appropriate status bits.
16.10.1 Interface Status Register (ISR)
The Interface Status Register (ISR) is an 8-bit read-only status register used by the Host
Processor to interrogate the status and flags of the HI8. The Host Processor can write this
相關PDF資料 |
PDF描述 |
|---|---|
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| SPAKDSP303GC100 | 制造商:Motorola Inc 功能描述: |
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