參數(shù)資料
型號(hào): PM8621
廠商: PMC-Sierra, Inc.
英文描述: NSE-8G⑩ Standard Product Data Sheet Preliminary
中文描述: 網(wǎng)絡(luò)搜索引擎,第八代⑩標(biāo)準(zhǔn)的產(chǎn)品數(shù)據(jù)的初步
文件頁數(shù): 168/184頁
文件大小: 1122K
代理商: PM8621
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁當(dāng)前第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
167
13 Functional Timing
13.1
Receive Interface Timing
Figure 35 below, shows the relative timing of the receive interface. The LVDS links carry
SONET/SDH frame octets that are encoded in 8B/10B characters. Frame boundaries, justification
events and alarm conditions are encoded in special control characters. The upstream devices
sourcing the links share a common clock and have a common transport frame alignment that is
synchronized by the Receive Serial Interface Frame Pulse signal (RC1FP). Due to phase noise of
clock multiplication circuits and backplane routing or cable length discrepancies, the links will
not phase aligned to each other but are frequency locked. The delay from RC1FP being sampled
high to the first and last C1 character is shown in Figure 35 In this example, the first C1 is
delivered on link RN[X]/RP[X]. The delay to the last C1 represents the time when the all the
links have delivered their C1 character. In the example below, link RN[Y]/RP[Y] is shown to be
the slowest.
The minimum value for the internal programmable delay (RC1DLY[13:0]) is the
delay through the SBS
2
plus 15. The maximum value is the delay through the SBS plus 31.
Consequently, the external system must ensure that the relative delays between all the receive
LVDS links be less than 16 bytes.
The relative phases of the links in Figure 35 are shown for
illustrative purposes only. Links may have different delays relative to other links than what is
shown.
Figure 36 Receive Interface Timing
RP[
X
]/
RN[
X
]
RN[
Y
]/
RP[
Y
]
...
SYSCLK
RC1FP
S4,3/
A2
S1,1/
C1
S2,1/
Z0
S4,3/
A2
S1,1/
C1
S2,1/
Z0
RC1DLY[13:0] Delay
...
...
...
...
...
Max Delay between
First and Last J0s
Max Delay until internal Frame Pulse
...
...
...
Min Delay until internal
Frame Pulse
2
This delay will be either one frame (9720 clock cycles) or one row (1080 clock cycles)
depending on the mode employed.
相關(guān)PDF資料
PDF描述
PM8621-BIAP NSE-8G⑩ Standard Product Data Sheet Preliminary
PM9311 Enhanced TT1TM Switch Fabric
PM9311-UC ENHANCED TT1⑩ SWITCH FABRIC
PM9312 Enhanced TT1TM Switch Fabric
PM9312-UC ENHANCED TT1⑩ SWITCH FABRIC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PM8621-BIAP 制造商:PMC 制造商全稱:PMC 功能描述:NSE-8G⑩ Standard Product Data Sheet Preliminary
PM87 制造商:FERROXCUBE 制造商全稱:Ferroxcube International Holding B.V. 功能描述:PM cores
PM87/70-3C94 制造商:Yageo / Ferroxcube 功能描述:FERRITE CORE PM 3C94 制造商:Yageo / Ferroxcube 功能描述:FERRITE CORE, PM, 3C94, Core Size:PM87, Material Grade:3C94, Effective Magnetic Path Length:146mm, Ae Effective Cross Section Area:910mm2, Inductance Factor Al:15000nH, SVHC:No SVHC (20-Jun-2013), External Depth:70mm, External , RoHS Compliant: Yes
PM871 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC