參數(shù)資料
型號: PM8621
廠商: PMC-Sierra, Inc.
英文描述: NSE-8G⑩ Standard Product Data Sheet Preliminary
中文描述: 網絡搜索引擎,第八代⑩標準的產品數(shù)據(jù)的初步
文件頁數(shù): 114/184頁
文件大小: 1122K
代理商: PM8621
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NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
113
Register 112h + N*20H, ILC Transmit Misc.Status and FIFO Synch Register
Bit
Type
Function
Default
Bit 31:16
Unused
X
Bit 15
R
TX_MSG_LVL_VALID
N/A
Bit 14:13
R
TX_LINK[1:0]
00
Bit 12:11
R
IPAGE[1:0]
N/A
Bit 10:8
R
IUSER[2:0]
N/A
Bit 7:6
R
Reserved
00
Bit 5:2
R
TX_MSG_LVL[3:0]
0000
Bit 1
R
TX_FI_BUSY
0
Bit 0
W
TX_XFER_SYNC
0
This register serves a dual purpose dependant on whether it is being read or written.
When it is read it returns the status for the Message Transmit Channel.
When it is written (with 0001h) to it is used it synchronize the Transmit FIFO to the start of a
message boundary.
TX_XFER_SYNC
Writing ‘1’ to this bit initializes the next write sequence to be to the beginning of the next
message. After a ‘1’ had been written successive writes to the Transmit FIFO will be to
location zero of the next available slot. If a partial message has been written,
TX_XFER_SYNC indicates that the current message is complete and that subsequent writes
will be to the next message. If more than 32 bytes are written, the 33rd byte will be the first
byte of the next message. The purpose of this bit is to unambiguously align the message
boundaries. Another use would be to abandon the current write and move the write pointer to
the beginning of the next message. (Previous message data will remain in the unwritten
portion of the message being abandoned, which will have to be ignored by the receiving
software).
If the message FIFO pointers are already at a message boundary then writing this bit to a ‘1’
will have no affect.
On reads this bit is always returned as a ‘0’.
TX_FI_BUSY
This bit indicates that the internal hardware is transferring the data from the Transmit FIFO
registers (TDAT) into the internal RAM. This bit need not be read by software if the time
interval between successive 32 bit transfers is greater than 3 SYSCLK cycles.
User and Page bits are a copy of the User bits received, and being transmitted in 0Ch. These
allow one read in the 32 bit device to gain a snapshot of the entire ILC.
相關PDF資料
PDF描述
PM8621-BIAP NSE-8G⑩ Standard Product Data Sheet Preliminary
PM9311 Enhanced TT1TM Switch Fabric
PM9311-UC ENHANCED TT1⑩ SWITCH FABRIC
PM9312 Enhanced TT1TM Switch Fabric
PM9312-UC ENHANCED TT1⑩ SWITCH FABRIC
相關代理商/技術參數(shù)
參數(shù)描述
PM8621-BIAP 制造商:PMC 制造商全稱:PMC 功能描述:NSE-8G⑩ Standard Product Data Sheet Preliminary
PM87 制造商:FERROXCUBE 制造商全稱:Ferroxcube International Holding B.V. 功能描述:PM cores
PM87/70-3C94 制造商:Yageo / Ferroxcube 功能描述:FERRITE CORE PM 3C94 制造商:Yageo / Ferroxcube 功能描述:FERRITE CORE, PM, 3C94, Core Size:PM87, Material Grade:3C94, Effective Magnetic Path Length:146mm, Ae Effective Cross Section Area:910mm2, Inductance Factor Al:15000nH, SVHC:No SVHC (20-Jun-2013), External Depth:70mm, External , RoHS Compliant: Yes
PM871 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC