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參數(shù)資料
| 型號(hào)： | PM7341 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | S/UNI INVERSE MULTIPLEXING FOR ATM, 84 LINKS |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA416 |
| 封裝： | 27 X 27 MM, 2.28 MM HEIGHT, PLASTIC, BGA-416 |
| 文件頁數(shù)： | 384/413頁 |
| 文件大小： | 3291K |
| 代理商： | PM7341 |
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PRELIMINARY
INVERSE MULTIPLEXING OVER ATM
PM7341 S/UNI-IMA-84
DATASHEET
PMC-2000223
ISSUE 4
INVERSE MULTIPLEXING OVER ATM
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
386
corresponding TSCLK[n] quiescent. In Figure 32, bits B5 and B2 are shown to be
stalled for one cycle while bit B6 is shown to be stalled for three cycles. In Figure
32, the quiescent period is shown to be a low level on TSCLK[n]. A high level,
effected by extending the high phase of the previous valid bit, is also acceptable.
Gapping of TSCLK[n] can occur arbitrarily without regard to either byte or frame
boundaries.
Figure 32
- Unchannelized Transmit Link Timing
TSCLK[n]
TSDATA[n]
B1 B2 B3 B4
B5
B6
B7 B8 B1
B2
The timing relationship of the transmit clock (TSCLK[n]) and data (TSDATA[n])
signals of a channelized T1 link is shown in Figure 33. The transmit data stream
is a T1 frame with a single framing bit (F in Figure 33) followed by octet bound
time-slots 1 to 24. TSCLK[n] is held quiescent during the framing bit. The most
significant bit of each time-slot is transmitted first (B1 in Figure 33). The least
significant bit of each time-slot is transmitted last (B8 in Figure 33). The
TSDATA[n] bit (B8 of TS24) before the framing bit is the least significant bit of
time-slot 24. In Figure 33, the quiescent period is shown to be a low level on
TSCLK[n]. A high level, effected by extending the high phase of bit B8 of time-slot
TS24, is equally acceptable. In channelized T1 mode, TSCLK[n] can only be
gapped during the framing bit. It must be active continuously at 1.544 MHz during
all time-slot bits. Time-slots that are not provisioned to belong to any channel (the
PROV bit in the corresponding word of the transmit channel provision RAM in the
TCAS block set low) transmit the contents of the Idle Fill Time-slot Data register.
Figure 33
- Channelized T1 Transmit Link Timing w/ Clock gapped Low
TSCLK[n]
TSDATA[n]
B7 B8
B1
B2 B3 B4 B5 B6 B7 B8 B1 B2 B3
TS 24
TS 1
TS 2
F
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7342 | 32 Link Inverse Multiplexer for ATM (IMA) / UNI PHY |
| PM7344 | SATURN QUAD T1/E1 MULTI-PHY USER NETWORK INTERFACE DEVICE |
| PM7345 | SATURN User Network Interface for PDH Applications |
| PM7346 | SATURN QUAD USER NETWORK INTERFACE FOR J2, E3, T3 |
| PM7347 | SATURN USER NETWORK INTERFACE for J2/E3/T3 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7342 | 制造商:PMC 制造商全稱:PMC 功能描述:32 Link Inverse Multiplexer for ATM (IMA) / UNI PHY |
| PM7344 | 制造商:PMC 制造商全稱:PMC 功能描述:SATURN QUAD T1/E1 MULTI-PHY USER NETWORK INTERFACE DEVICE |
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