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參數(shù)資料
| 型號(hào)： | PM7325 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | S/UNI-ATLAS-3200 Telecom Standard Product Data Sheet Preliminary |
| 中文描述： | S/UNI-ATLAS-3200電信標(biāo)準(zhǔn)產(chǎn)品數(shù)據(jù)的初步 |
| 文件頁(yè)數(shù)： | 198/432頁(yè) |
| 文件大小： | 2406K |
| 代理商： | PM7325 |
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S/UNI-ATLAS-3200 Telecom Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-1990553, Issue 4
198
RMtoUP
If the RMtoUP bit is logic 1, all RM cells are copied to the Microprocessor Cell Interface.
RM cells are identified PTI=110 for VC-RM cells and by VCI=6 for VP-RM cells. If the
VP_RM_PTI6 register bit is logic 1, VP-RM cells are further qualified by PTI=110.
RMtoBCIF
If the RMtoBCIF bit is logic 1, all RM cells are copied to the Backwards Cell Interface. RM
cells are identified PTI=110 for VC-RM cells and by VCI=6 for VP-RM cells. If the
VP_RM_PTI6 register is logic 1, VP-RM cells are further qualified by PTI=110.
DropRM
If the DropRM bit is logic 1, all RM cells are dropped (i.e. not passed to the OCIF) though
they may be passed to the MCIF or BCIF based on the RMtoBCIF and RMtoUP register bits.
RM cells are identified PTI=110 for VC-RM cells and by VCI=6 for VP-RM cells. If the
VP_RM_PTI6 register bit of the Search Engine Configuration configuration register is logic
1, VP-RM cells are further qualified by PTI=110.
DROPCRCERM
If this bit is logic 1, all Forward and Backward RM cells with an incorrect CRC-10 are
discarded. If this bit is logic 0, then all Forward and Backward RM cells are output to the
Output Cell Interface regardless of whether their CRC-10 is correct or not.
BADVCtoUP
If the BADVCtoUP bit is logic 1, all cells with an unprovisioned VPI/VCI are dropped and
routed to the Microprocessor Cell Interface. If this bit is logic 0, those cells are discarded by
the S/UNI-ATLAS-3200 without being routed to the Microprocessor Cell Interface.
DROPINVPTIVCI
If this bit is logic 1, all F5 (VCC) cells with PTI=111 and all F4 (VPC) cells with a VCI of 7
through 15 are not routed to the Output Cell Interface. If DROPINVPTIVCI is logic 0, these
cells are passed transparently.
INVPTIVCItoUP
If the INVPTIVCItoUP bit is logic 1, all F5 (VCC) cells with an invalid PTI field (PTI=111)
and all F4 (VPC) cells with an invalid VCI field (VCI 7 through 15) are copied to the
Microprocessor Cell Interface. The DROPINVPTIVCI register bit determines whether cells
with invalid PTI or VCI fields are passed to the Output Cell Interface.
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