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參數(shù)資料
| 型號(hào)： | MT48LC4M16A2P-75:G |
| 元件分類(lèi)： | DRAM |
| 英文描述： | 4M X 16 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
| 封裝： | 0.400 INCH, ROHS COMPLIANT, PLASTIC, TSOP2-54 |
| 文件頁(yè)數(shù)： | 51/72頁(yè) |
| 文件大?。?/td> | 3455K |
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PDF: 09005aef80725c0b/Source: 09005aef806fc13c
Micron Technology, Inc., reserves the right to change products or specifications without notice.
64MSDRAM_2.fm - Rev. N 12/08 EN
55
2000 Micron Technology, Inc. All rights reserved.
64Mb: x4, x8, x16 SDRAM
Timing Diagrams
Figure 38:
Auto Refresh Mode
Notes:
1. Each AUTO REFRESH command performs a refresh cycle. Back-to-back commands are not
required.
tCH
tCL
tCK
CKE
CLK
DQ
tRFC1
(
)
(
)
(
)
(
)
tRP
(
)
(
)
(
)
(
)
(
)
(
)
COMMAND
tCMH
tCMS
NOP
(
)
(
)
(
)
(
)
BANK
ACTIVE
AUTO
REFRESH
(
)
(
)
(
)
(
)
NOP
PRECHARGE
Precharge all
active banks
AUTO
REFRESH
tRFC1
High-Z
BA0, BA1
BANK(S)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
tAH
tAS
tCKH
tCKS
(
)
(
)
NOP
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
DQM /
DQML, DQMH
A0–A9, A11
ROW
(
)
(
)
(
)
(
)
ALL BANKS
SINGLE BANK
A10
ROW
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
T0
T1
T2
Tn + 1
To + 1
DON’T CARE
(
)
(
)
(
)
(
)
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