參數(shù)資料
型號： MPC565MZP56R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁數(shù)： 864/1387頁
文件大?。?/td> 18462K
代理商： MPC565MZP56R2
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MOTOROLA
Chapter 13. Queued Analog-To-Digital Converter (QADC64E)
13-21
Programming the QADC64E Registers
13.2.7 Control Register 2
Control register 2 is the mode control register for the operation of queue 2. Software
specifies the queue operating mode of queue 2, and may enable a completion and/or a pause
interrupt. All control register fields are read/write data, except the SSE2 bit, which is
readable only when the test mode is enabled. Most of the bits are typically written once
when the software initializes the QADC64E, and not changed afterwards.
10110
Periodic timer continuous-scan mode: time = QCLK period x 2 9
10111
Periodic timer continuous-scan mode: time = QCLK period x 210
11000
Periodic timer continuous-scan mode: time = QCLK period x 211
11001
Periodic timer continuous-scan mode: time = QCLK period x 212
11010
Periodic timer continuous-scan mode: time = QCLK period x 21
11011
Periodic timer continuous-scan mode: time = QCLK period x 214
11100
Periodic timer continuous-scan mode: time = QCLK period x 215
11101
Periodic timer continuous-scan mode: time = QCLK period x 216
11110
Periodic l timer continuous-scan mode: time = QCLK period x 217
11111
External gated continuous-scan mode
MSB
0
123456
7
8
9
10
11
12
13
14
LSB
15
CIE2
PIE2 SSE2
MQ2
RESUME
BQ2
RESET:
00
00000
0
1111
11
1
Figure 13-12. QACR2 — Control Register 2 0x30 480E, 0x30 4C0E
Table 13-12. QACR2 Bit Descriptions
Bit(s)
Name
Description
0
CIE2
Queue 2 Completion Software Interrupt Enable — CIE2 enables an interrupt upon completion
of queue 2. The interrupt request is initiated when the conversion is complete for the CCW in
queue 2.
0 Disable the queue completion interrupt associated with queue 2
1 Enable an interrupt after the conversion of the sample requested by the last CCW in queue 2
1
PIE2
Queue 2 Pause Software Interrupt Enable — PIE2 enables an interrupt when queue 2 enters
the pause state. The interrupt request is initiated when conversion is complete for a CCW that
has the pause bit set.
0 Disable the pause interrupt associated with queue 2
1 Enable an interrupt after the conversion of the sample requested by a CCW in queue 2 which
has the pause bit set
Table 13-11. Queue 1 Operating Modes (continued)
MQ1[3:7]
Operating Modes
相關(guān)PDF資料
PDF描述
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC60333 32-BIT, 33.33 MHz, RISC PROCESSOR, CQFP240
MPC603CQ50 32-BIT, 50 MHz, RISC PROCESSOR, CQFP240
MPC60340 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
MPC603CQ40 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC566 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEXUS Debugger and Trace for PowerPC
MPC5668E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668G 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMG 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMGR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
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