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參數(shù)資料
| 型號： | MFRC52301HN1 |
| 廠商： | NXP Semiconductors N.V. |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Contactless reader IC |
| 封裝： | MFRC52301HN1<SOT617-1 (HVQFN32)|<<http://www.nxp.com/packages/SOT617-1.html<1<Always Pb-free,;MFRC52301HN1<SOT617-1 (HVQFN32)|<<http://www.nxp.com/packages/SOT617-1.html& |
| 文件頁數(shù)： | 93/98頁 |
| 文件大?。?/td> | 1666K |
| 代理商： | MFRC52301HN1 |
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MFRC523
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NXP B.V. 2011. All rights reserved.
Product data sheet
COMPANY PUBLIC
Rev. 3.7 — 8 November 2011
115237
93 of 98
continued >>
NXP Semiconductors
MFRC523
Contactless reader IC
26. Tables
Table 1. Quick reference data . . . . . . . . . . . . . . . . . . . . .2
Table 2. Ordering information . . . . . . . . . . . . . . . . . . . . .3
Table 3. Pin description . . . . . . . . . . . . . . . . . . . . . . . . . .6
Table 4. Communication overview for ISO/IEC 14443 A
reader/writer . . . . . . . . . . . . . . . . . . . . . . . . . . .8
Table 5. Connection protocol for detecting different
interface types . . . . . . . . . . . . . . . . . . . . . . . . .10
Table 6. MOSI and MISO byte order . . . . . . . . . . . . . . .11
Table 7. MOSI and MISO byte order . . . . . . . . . . . . . . .11
Table 8. SPI read address . . . . . . . . . . . . . . . . . . . . . . .11
Table 9. SPI write address . . . . . . . . . . . . . . . . . . . . . .12
Table 10. BR_T0 and BR_T1 settings . . . . . . . . . . . . . . .12
Table 11. Selectable UART transfer speeds . . . . . . . . . .13
Table 12. UART framing . . . . . . . . . . . . . . . . . . . . . . . . .13
Table 13. Read data byte order . . . . . . . . . . . . . . . . . . . .14
Table 14. Write data byte order . . . . . . . . . . . . . . . . . . . .14
Table 15. Address byte 0 register; address MOSI . . . . . .16
Table 16. Register and bit settings controlling the signal on
pin TX1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .23
Table 17. Register and bit settings controlling the signal on
pin TX2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .24
Table 18. CRC coprocessor parameters . . . . . . . . . . . . .27
Table 19. Interrupt sources . . . . . . . . . . . . . . . . . . . . . . .29
Table 20. Behavior of register bits and their designation .32
Table 21. MFRC523 register overview . . . . . . . . . . . . . .33
Table 22. Reserved register (address 00h); reset value: 00h
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . .36
Table 23. Reserved register bit descriptions . . . . . . . . . .36
Table 24. CommandReg register (address 01h); reset
value: 20h bit allocation . . . . . . . . . . . . . . . . . .36
Table 25. CommandReg register bit descriptions . . . . . .36
Table 26. ComIEnReg register (address 02h); reset value:
80h bit allocation . . . . . . . . . . . . . . . . . . . . . . .37
Table 27. ComIEnReg register bit descriptions . . . . . . . .37
Table 28. DivIEnReg register (address 03h); reset value:
00h bit allocation . . . . . . . . . . . . . . . . . . . . . . .37
Table 29. DivIEnReg register bit descriptions . . . . . . . . .37
Table 30. ComIrqReg register (address 04h); reset value:
14h bit allocation . . . . . . . . . . . . . . . . . . . . . . .38
Table 31. ComIrqReg register bit descriptions . . . . . . . .38
Table 32. DivIrqReg register (address 05h); reset value: x0h
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . .39
Table 33. DivIrqReg register bit descriptions . . . . . . . . . .39
Table 34. ErrorReg register (address 06h); reset value: 00h
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . .40
Table 35. ErrorReg register bit descriptions . . . . . . . . . .40
Table 36. Status1Reg register (address 07h); reset value:
21h bit allocation . . . . . . . . . . . . . . . . . . . . . . .40
Table 37. Status1Reg register bit descriptions . . . . . . . . 41
Table 38. Status2Reg register (address 08h); reset value:
00h bit allocation . . . . . . . . . . . . . . . . . . . . . . . 41
Table 39. Status2Reg register bit descriptions . . . . . . . . 41
Table 40. FIFODataReg register (address 09h); reset value:
xxh bit allocation . . . . . . . . . . . . . . . . . . . . . . . 42
Table 41. FIFODataReg register bit descriptions . . . . . . 42
Table 42. FIFOLevelReg register (address 0Ah); reset
value: 00h bit allocation . . . . . . . . . . . . . . . . . 42
Table 43. FIFOLevelReg register bit descriptions . . . . . . 43
Table 44. WaterLevelReg register (address 0Bh); reset
value: 08h bit allocation . . . . . . . . . . . . . . . . . 43
Table 45. WaterLevelReg register bit descriptions . . . . . 43
Table 46. ControlReg register (address 0Ch); reset value:
10h bit allocation . . . . . . . . . . . . . . . . . . . . . . . 43
Table 47. ControlReg register bit descriptions . . . . . . . . 43
Table 48. BitFramingReg register (address 0Dh); reset
value: 00h bit allocation . . . . . . . . . . . . . . . . . 44
Table 49. BitFramingReg register bit descriptions . . . . . 44
Table 50. CollReg register (address 0Eh); reset value: xxh
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . 44
Table 51. CollReg register bit descriptions . . . . . . . . . . . 44
Table 52. Reserved register (address 0Fh); reset value: 00h
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . 45
Table 53. Reserved register bit descriptions . . . . . . . . . . 45
Table 54. Reserved register (address 10h); reset value: 00h
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . 45
Table 55. Reserved register bit descriptions . . . . . . . . . . 45
Table 56. ModeReg register (address 11h); reset value: 3Fh
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . 46
Table 57. ModeReg register bit descriptions . . . . . . . . . 46
Table 58. TxModeReg register (address 12h); reset value:
00h bit allocation . . . . . . . . . . . . . . . . . . . . . . . 47
Table 59. TxModeReg register bit descriptions . . . . . . . 47
Table 60. RxModeReg register (address 13h); reset value:
00h bit allocation . . . . . . . . . . . . . . . . . . . . . . . 47
Table 61. RxModeReg register bit descriptions . . . . . . . 47
Table 62. TxControlReg register (address 14h); reset value:
80h bit allocation . . . . . . . . . . . . . . . . . . . . . . . 48
Table 63. TxControlReg register bit descriptions . . . . . . 48
Table 64. TxASKReg register (address 15h); reset value:
00h bit allocation . . . . . . . . . . . . . . . . . . . . . . . 49
Table 65. TxASKReg register bit descriptions . . . . . . . . 49
Table 66. TxSelReg register (address 16h); reset value: 10h
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . 49
Table 67. TxSelReg register bit descriptions . . . . . . . . . 49
Table 68. RxSelReg register (address 17h); reset value: 84h
bit allocation . . . . . . . . . . . . . . . . . . . . . . . . . . 50
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MFRC53001T | ISO-IEC 14443 A Reader IC |
| MFRC53101T | ISO-IEC 14443 reader IC |
| MFRX85201HD | Secure contactless reader solution |
| MMBD4148 | High-speed switching diode |
| MMBD6050-V-GS08 | SWITING 70V 0.2A 3PIN SOT-23 - Tape and Reel |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MFRC52301HN1,151 | 功能描述:RFID應(yīng)答器 IC TRANSMISSION MOD 32-HVQFN RoHS:否 制造商:Murata 存儲容量:512 bit 工作溫度范圍:- 40 C to + 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體: 封裝:Reel |
| MFRC52301HN1,157 | 功能描述:RFID應(yīng)答器 IC TRANSMISSION MOD 32-HVQFN RoHS:否 制造商:Murata 存儲容量:512 bit 工作溫度范圍:- 40 C to + 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體: 封裝:Reel |
| MFRC52301HN1/TRAYB | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Contactless reader IC |
| MFRC52301HN1/TRAYBM | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Contactless reader IC |
| MFRC52302HN1,151 | 功能描述:RFID應(yīng)答器 CONTACTLESS READER IC RoHS:否 制造商:Murata 存儲容量:512 bit 工作溫度范圍:- 40 C to + 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體: 封裝:Reel |
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