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參數(shù)資料
| 型號： | MC145170 |
| 廠商： | Motorola, Inc. |
| 英文描述： | PLL Frequency Synthesizer(PLL頻率發(fā)生器) |
| 中文描述： | 鎖相環(huán)頻率合成器（PLL頻率發(fā)生器） |
| 文件頁數(shù)： | 4/14頁 |
| 文件大小： | 173K |
| 代理商： | MC145170 |
4
MOTOROLA RF/IF APPLICATIONS INFORMATION
Ref
Delay
50 ns
Delay
50 ns
DL2
DL1
HB3
HB4
HB6
HB5
v1Out
v1Out
v1Out
v1Out
v2
In2
In1
Out
In2
In1
Out
HB2
HB1
nor2
nor2
nor2
2
1
2
1
U4
U5
3
3
nor2
2
1
2
1
U2
U3
3
3
phiV
phiR
In
M3
M1
PWR
GND
M4
M2
Figure 7.
GND
PWR
Ref
Delay
50 ns
Delay
50 ns
DL2
DL1
HB3
v1Out
HB4
v1Out
HB6
HB5
v2
v2
v1Out
v1Out
In2
In2
HB1
HB2
nor2
nor2
nor2
2
1
2
1
U4
U5
3
3
nor2
2
1
2
1
U2
U3
3
3
GND
PWR
In
M4
M2
Figure 8.
PDout
To insure correct operation, HB1 and HB2 must be
modified for each variation in configuration. For example, To
insure the correct polarity for the output pulses, R and V
outputs must reflect the correct polarity. This is achieved by
the IF statement of HB1 and HB2. For applications where the
behavioral gates drive the loop filter, the equation is as shown
in Figure 6. When the transistor buffer/inverters are added,
the circuit must be modified to produce the correct polarity
output, Figure 9.
Similar changes must be made when using the PDout
model. HB1 is represented by the circuit in Figure 9 and HB2
is represented by the circuit in Figure 6.
Figure 9.
In1
In1
In2
In2
Out
IF (V(In1)
≥
1 | V(In2)
≥
1, 5, 0)
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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