參數(shù)資料
型號： MB8118165B-50
廠商： Fujitsu Limited
英文描述： CMOS 1M ×16 BIT Hyper Page Mode Dynamic RAM(CMOS 1M ×16 位超級頁面存取模式動態(tài)RAM)
中文描述： 的CMOS 100萬× 16位的超頁模式動態(tài)RAM的CMOS（100萬× 16位超級頁面存取模式動態(tài)內(nèi)存）
文件頁數(shù)： 14/28頁
文件大?。?/td> 651K
代理商： MB8118165B-50
14
MB8118165B-50/-60
Fig. 7 – DELAYED WRITE CYCLE (OE CONTROLLED)
RAS
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
LCAS
or
UCAS
WE
DQ
(Input)
A
0
to A
9
V
OH
V
OL
DQ
(Output)
V
IH
V
IL
OE
DESCRIPTION
In the delayed write cycle, t
WCS
is not satisfied; thus, the data on the DQ pins are latched with the falling edge of WE and written
into memory. The Output Enable (OE) signal must be changed from Low to High before WE goes Low (t
OED
+ t
T
+ t
DS
).
t
RC
t
RAS
t
CAS
t
RCD
t
ASR
t
CAH
t
RCS
t
DZC
t
CSH
t
RP
t
ASC
t
RAH
t
CWL
t
WP
t
DS
t
DH
t
OED
t
DZO
t
OEH
ROW
ADD
COL
ADD
VALID
DATA IN
t
RSH
t
WCH
t
RWL
HIGH-Z
HIGH-Z
HIGH-Z
t
ON
t
ON
t
AR
t
CRP
t
OEZ
Invalid Data
“H” or “L” level (excluding Address and DQ)
“H” or “L” level, “H
→
L” or “L
→
H” transition (Address and DQ)
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PDF描述
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