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參數資料
| 型號： | M37281MKH-XXXSP |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER with CLOSED CAPTION DECODER and ON-SCREEN DISPLAY CONTROLLER |
| 中文描述： | 單芯片8位CMOS微機隱蔽字幕解碼器和屏幕顯示控制器 |
| 文件頁數： | 145/172頁 |
| 文件大?。?/td> | 1319K |
| 代理商： | M37281MKH-XXXSP |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁當前第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁
Rev.1.01 2003.07.16 page 145 of 170
M37281MAH
–
XXXSP,M37281MFH
–
XXXSP,M37281MKH
–
XXXSP, M37281EKSP
Address 00EA
16
7 b
6 b
5 b
4 b
3 b
2 b
1 b
0
C
l
o
c
k
r
u
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-
i
n
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c
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(
C
R
D
)
[
A
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s
0
0
E
A
1
6
]
R
W
C
l
o
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k
R
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n
-
i
n
D
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t
e
c
t
R
e
g
i
s
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e
r
0
t
o
2
3
t
o
7
0
R
—
Test bits
N
b
p
u
e
u
m
c
l
s
b
o
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u
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.
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c
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k
o
c
r
k
u
s
n
-
t
i
o
n
n
e
o
i
Clock run-in detection
bit(CRD3 to CRD7)
0
R
—
R
e
a
d
-
o
n
l
y
B
A
f
t
e
r
r
e
s
e
t
Functions
N
a
m
e
Address 00E6
16
Address 00E9
16
b7 b6 b5 b4 b3 b2 b1 b0
Caption Position Register (CPS) [Address 00E6
16
]
Caption Position Register
0
to
4
5
0
R W
0
R W
Caption position
bits(CPS0 to CPS4)
6, 7
Refer to the corresponding
Table (Table 8.10.1).
Slice line mode
specification bits
(in 1 field) (CPS6, CPS7)
0: Data is not latched yet and a
clock-run-in is not determined.
1: Data is latched and a
clock-run-in is determined.
Caption data latch
completion flag 2
(CPS5)
Indeterminate R
—
B
After reset
Functions
Name
R W
b7 b6 b5 b4 b3 b2 b1 b0
Sync pulse counter register (HC) [Address 00E9
16
]
R W
Sync Pulse Counter Register
0
to
4
Indeterminate
R
—
6, 7
0
R
—
Count value (HC0 to HC4)
5
0
R W
Count source (HC5)
0: H
SYNC
signal
1: Composite sync signal
B
After reset
Functions
Name
Nothing is assigned. These bits are write disable bits.
When these bits are read out, the values are
“
0.
”
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PDF描述 |
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