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參數(shù)資料
| 型號： | M37281MKH-XXXSP |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER with CLOSED CAPTION DECODER and ON-SCREEN DISPLAY CONTROLLER |
| 中文描述： | 單芯片8位CMOS微機隱蔽字幕解碼器和屏幕顯示控制器 |
| 文件頁數(shù)： | 144/172頁 |
| 文件大小： | 1319K |
| 代理商： | M37281MKH-XXXSP |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁當前第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁
M37281MAH
–
XXXSP,M37281MFH
–
XXXSP,M37281MKH
–
XXXSP, M37281EKSP
Rev.1.01 2003.07.16 page 144 of 170
Address 00E0
16
b7b6b5b4b3b2b1b0
0 0
0
0 0
Data slicer control register 1(DSC1) [Address 00E0
16
]
Data Slicer Control Register 1
0
0
R W
0
R W
2
Reference clock source
selection bit (DSC12)
Fix these bits to
“
0.
”
0: Video signal
1: H
SYNC
signal
0
R W
0
R W
0: Stopped
1: Operating
0: F2
1: F1
Data slicer and timing signal
generating circuit control bit (DSC10)
Selection bit of data slice reference
voltage generating field (DSC11)
3 to
7
1
Definition of fields 1 (F1) and 2 (F2)
H
sep
V
sep
F1:
H
sep
V
sep
F2:
B
After reset
R W
Name
Functions
Address 00E1
16
b7 b6 b5 b4 b3 b2 b1 b0
0
Data slicer control register 2 (DSC2) [Address 00E1
16
]
Data Slicer Control Register 2
0
Indeterminate
0
Indeterminate
Indeterminate
0
0: Data is not latched yet and a
clock-run-in is not determined.
1: Data is latched and a
clock-run-in is determined.
Caption data latch
completion flag 1
(DSC20)
Fix this bit to
“
0.
”
Read-only
Test bit
3
0: F2
1: F1
Field determination
flag(DSC23)
4
0: Method (1)
1: Method (2)
Vertical synchronous signal
(V
sep
) generating method
selection bit (DSC24)
0
5
0: Match
1: Mismatch
V-pulse shape
determination flag (DSC25)
Indeterminate
B
After reset
Functions
Name
Definition of fields 1 (F1) and 2 (F2)
H
sep
V
sep
F1:
H
sep
V
sep
F2:
0
Indeterminate
R W
R
—
R W
R
—
R
—
R W
R
—
R W
R
—
Fix this bit to
“
0.
”
Read-only
Test bit
6
7
1
2
相關(guān)PDF資料 |
PDF描述 |
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