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參數(shù)資料
| 型號： | LPC47B37X |
| 廠商： | SMSC Corporation |
| 英文描述： | 100 Pin Enhanced Super I/O for LPC Bus with SMBus Controller for Commercial Applications |
| 中文描述： | 100引腳增強的超級I / O控制器，帶有SMBus為商業(yè)應用的LPC總線 |
| 文件頁數(shù)： | 91/254頁 |
| 文件大?。?/td> | 659K |
| 代理商： | LPC47B37X |
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Data Port
ADDRESS OFFSET = 00H
The Data Port is located at an offset of '00H' from the base address. The data register is cleared at
initialization by RESET. During a WRITE operation, the Data Register latches the contents of the internal
data bus. The contents of this register are buffered (non inverting) and output onto the PD0 - PD7 ports.
During a READ operation in SPP mode, PD0 - PD7 ports are buffered (not latched) and output to the host
CPU.
Status Port
ADDRESS OFFSET = 01H
The Status Port is located at an offset of '01H' from the base address. The contents of this register are
latched for the duration of a read cycle. The bits of the Status Port are defined as follows:
BIT 0 TMOUT - TIME OUT
This bit is valid in EPP mode only and indicates that a 10 usec time out has occurred on the EPP bus. A
logic O means that no time out error has occurred; a logic 1 means that a time out error has been
detected.
The TIMEOUT_SELECT bit is used to control the means of clearing the TIMEOUT bit. The TIMEOUT
bit is located at bit 0 of the status port register at base address offset 0x01. The TIMEOUT_SELECT bit
is located at bit 4 of the Parallel Port Mode Register 2 (0xF1 in LD3). The default of the
TIMEOUT_SELECT bit is ‘0’.
The means of clearing the TIMEOUT bit is controlled by the TIMEOUT_SELECT bit as follows:
If the TIMEOUT_SELECT bit is cleared (‘0’), the TIMEOUT bit is cleared on a write of ‘1’ to the
TIMEOUT bit (default). On a write, the TIMEOUT bit is self clearing and does not require a write of
a zero. Writing a zero to this bit has no effect.
If the TIMEOUT_SELECT bit is set (‘1’), the TIMEOUT bit is cleared on the trailing edge of the read
of the EPP Status Register
The TIMEOUT bit is cleared on PCI_RESET regardless of the state of the TIMEOUT_SELECT bit.
BITS 1, 2
- are not implemented as register bits, during a read of the Printer Status Register these bits are
a low level.
BIT 3 nERR - nERROR
The level on the nERROR input is read by the CPU as bit 3 of the Printer Status Register. A logic 0
means an error has been detected; a logic 1 means no error has been detected.
BIT 4 SLCT - PRINTER SELECTED STATUS
The level on the SLCT input is read by the CPU as bit 4 of the Printer Status Register. A logic 1 means
the printer is on line; a logic 0 means it is not selected.
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PDF描述 |
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| LPC47M107QFP | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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