參數(shù)資料
型號： LPC47B37X
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with SMBus Controller for Commercial Applications
中文描述： 100引腳增強的超級I / O控制器，帶有SMBus為商業(yè)應用的LPC總線
文件頁數(shù)： 23/254頁
文件大?。?/td> 659K
代理商： LPC47B37X
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BIT 3 nHEAD SELECT
Active low status of the HDSEL disk interface input. A logic "0" selects side 1 and a logic "1" selects side
0.
BIT 4 TRACK 0
Active high status of the TRK0 disk interface input.
BIT 5 STEP
Active high status of the latched STEP disk interface output pin. This bit is latched with the STEP output
going active, and is cleared with a read from the DIR register, or with a hardware or software reset.
BIT 6 DMA REQUEST
Active high status of the DMA request pending.
BIT 7 INTERRUPT PENDING
Active high bit indicating the state of the Floppy Disk Interrupt.
Status Register B (SRB)
Address 3F1 READ ONLY
This register is read-only and monitors the state of several disk interface pins in PS/2 and model 30
modes. The SRB can be accessed at any time when in PS/2 mode. In the PC/AT mode the data bus pins
D0 - D7 are held in a high impedance state for a read of address 3F1.
PS/2 Mode
7
1
6
1
5
4
3
2
1
0
DRIVE
SEL0
0
WDATA
TOGGLE
0
RDATA
TOGGLE
0
WGATE
MOT
EN1
0
MOT
EN0
0
RESET
COND.
1
1
0
BIT 0 MOTOR ENABLE 0
Active high status of the MTR0 disk interface output pin. This bit is low after a hardware reset and
unaffected by a software reset.
BIT 1 MOTOR ENABLE 1
Active high status of the MTR1 disk interface output pin. This bit is low after a hardware reset and
unaffected by a software reset.
BIT 2 WRITE GATE
Active high status of the WGATE disk interface output.
BIT 3 READ DATA TOGGLE
Every inactive edge of the RDATA input causes this bit to change state.
BIT 4 WRITE DATA TOGGLE
Every inactive edge of the WDATA input causes this bit to change state.
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