參數(shù)資料
型號： LPC47B37X
廠商： SMSC Corporation
英文描述： 100 Pin Enhanced Super I/O for LPC Bus with SMBus Controller for Commercial Applications
中文描述： 100引腳增強的超級I / O控制器，帶有SMBus為商業(yè)應(yīng)用的LPC總線
文件頁數(shù)： 9/254頁
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代理商： LPC47B37X
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9
PIN #
95
NAME
FUNCTION
BUFFER
TYPE
IS/O8
BUFFER TYPE PER
FUNCTION (NOTE 1)
(IS/O8/OD8)/IS/IS
GP52 /RXD2/IRRX
General Purpose I/O /Receive
Data 2/IRRX
General Purpose I/O /Transmit
Data 2/IRTX
(Note 5)
General Purpose I/O /Data Set
Ready 2
General Purpose I/O /Request
to Send 2
General Purpose I/O /Clear to
Send 2
General Purpose I/O /Data
Terminal Ready 2
POWER PINS
+3.3 Volt Supply Voltage
96
GP53 /TXD2/IRTX
IO12
(I/O12/OD12)/O12/O
12
97
GP54 /nDSR2
IO8
(I/O8/OD8)/I
98
GP55/nRTS2
IO8
(I/O8/OD8)/O8
99
GP56/nCTS2
IO8
(I/O8/OD8)/I
100
GP57/nDTR2
IO8
(I/O8/OD8)/O8
53, 65,
93
18
VCC
VTR
+3.3 Volt Standby Supply
Voltage (Note 6)
Ground
7, 31,
60, 76
VSS
CLOCK PINS
6
CLKI32
32.768kHz Standby Clock
Input (Note 3)
14.318MHz Clock Input
IS
IS
19
CLOCKI
IS
IS
Note:
Note 1: Buffer types per function on multiplexed pins are separated by a slash “/”. Buffer types in
parenthesis represent multiple buffer types for a single pin function.
Note 2: The nLPCPD pin may be tied high. The LPC interface will function properly if the
nPCI_RESET signal follows the protocol defined for the nLRESET signal in the “Low Pin Count
Interface Specification”.
Note 3: If the 32kHz input clock is not used the CLKI32 pin must be grounded. There is a bit in the
configuration register at 0xF0 in Logical Device A that indicates whether or not the 32KHz
clock is connected. This bit determines the clock source for the fan tachometer, LED and
“wake on specific key” logic. Set this bit to ‘1’ if the clock is not connected.
Note 4: The fan control pin (FAN) comes up as output and low following a VCC POR and Hard Reset.
This pin reverts to its non-inverting General Purpose I/O output function when VCC is removed
from the part.
Note 5: The GP53/TXD2/IRTX pin is an output and low when the part is under VTR power (VCC=0).
The pin comes up as output and low following a VCC POR and Hard Reset.
Note 6: VTR can be connected to VCC if no wakeup functionality is required.
Note 7: The GP24/SYSOPT pin requires an external pulldown resistor to put the base I/O address for
configuration at 0x02E. An external pullup resistor is required to move the base I/O address
for configuration to 0x04E.
The "n" as the first letter of a signal name indicates an "Active Low" signal.
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