參數(shù)資料
型號(hào): LPC47B37X
廠商: SMSC Corporation
英文描述: 100 Pin Enhanced Super I/O for LPC Bus with SMBus Controller for Commercial Applications
中文描述: 100引腳增強(qiáng)的超級(jí)I / O控制器,帶有SMBus為商業(yè)應(yīng)用的LPC總線
文件頁數(shù): 202/254頁
文件大小: 659K
代理商: LPC47B37X
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202
Chip Level (Global) Control/Configuration Registers[0x00-0x2F]
The chip-level (global) registers lie in the address range [0x00-0x2F]. The design MUST use all 8 bits of
the ADDRESS Port for register selection. All unimplemented registers and bits ignore writes and return
zero when read.
The INDEX PORT is used to select a configuration register in the chip. The DATA PORT is then used to
access the selected register. These registers are accessible only in the Configuration Mode.
Table 64 - Chip Level Registers
ADDRESS
Chip (Global) Control Registers
0x00 -
0x01
0x02 W
The hardware automatically clears this bit after the
write, there is no need for software to clear the bits.
Bit 0 = 1: Soft Reset. Refer to the "Configuration
Registers" table for the soft reset value for each
register.
REGISTER
DESCRIPTION
STATE
Reserved - Writes are ignored, reads return 0.
Config Control
Default = 0x00
on VCC POR ,
VTR POR and
HARD RESET
N/A
C
0x03 - 0x06
Reserved - Writes are ignored, reads return 0
.
Logical Device #
Default = 0x00
on VCC POR,
VTR POR,
HARD RESET and
SOFT RESET
Card Level Reserved
0x07 R/W
A write to this register selects the current logical
device. This allows access to the control and
configuration registers for each logical device. Note:
The Activate command operates only on the selected
logical device.
C
0x08 - 0x1F
Reserved - Writes are ignored, reads return 0
.
Chip Level, SMSC Defined
A read only register which provides device
identification. Bits[7:0] = 0x52 when read.
Device ID
Default = 0x52
VCC POR,
VTR POR,
HARD RESET and
SOFT RESET
Device Rev
0x20 R
C
Default = Current
Rev
VCC POR,
VTR POR,
HARD RESET and
SOFT RESET
0x21 R
A read only register which provides device revision
information.
C
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