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參數(shù)資料
| 型號： | ISP1563BM,557 |
| 廠商： | ST-ERICSSON |
| 元件分類： | 總線控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-420-1, LQFP-100 |
| 文件頁數(shù)： | 76/102頁 |
| 文件大?。?/td> | 466K |
| 代理商： | ISP1563BM,557 |
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ISP1563_2
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 02 — 15 March 2007
75 of 102
NXP Semiconductors
ISP1563
HS USB PCI Host Controller
11.4.5 PERIODICLISTBASE register
The Periodic Frame List Base Address (PERIODLISTBASE) register contains the
beginning address of the periodic frame list in the system memory. If the Host Controller is
in 64-bit mode, as indicated by logic 1 in 64AC (bit 0 in the HCCPARAMS register), the
most signicant 32 bits of every control data structure address comes from the
CTRLDSSEGMENT register. For details on the CTRLDSSEGMENT register, refer to
Enhanced Host Controller Interface Specication for Universal Serial Bus Rev. 1.0. The
system software loads this register before starting the schedule execution by the Host
Controller. The memory structure referenced by this physical memory pointer is assumed
as 4 kB aligned. The contents of this register are combined with the FRINDEX register to
enable the Host Controller to step through the periodic frame list in sequence.
The bit allocation is given in Table 112.
Table 110. FRINDEX - Frame Index register bit description
Address: Content of the base address register + 2Ch
Bit
Symbol
Description
31 to 14
reserved
-
13 to 0
FRINDEX
[13:0]
Frame Index: Bits in this register are used for the frame number in the SOF packet and as the index
into the frame list. The value in this register increments at the end of each time frame. For example,
microframe. The bits used for the frame number in the SOF token are taken from bits 13 to 3 of this
register. Bits N to 3 are used for the frame list current index. This means that each location of the
frame list is accessed eight times, frames or microframes, before moving to the next index. Table 111
illustrates values of N based on the value of FLS[1:0] (bits 3 to 2 in the USBCMD register).
Table 111. N based value of FLS[1:0]
FLS[1:0]
Number elements
N
00b
1024
12
01b
512
11
10b
256
10
11b
reserved
-
Table 112. PERIODICLISTBASE - Periodic Frame List Base Address register bit allocation
Address: Content of the base address register + 34h
Bit
31
30
29
28
27
26
25
24
Symbol
BA[19:12]
Reset
00000000
Access
R/W
Bit
23
22
21
20
19
18
17
16
Symbol
BA[11:4]
Reset
00000000
Access
R/W
Bit
15
14
13
12
11
10
9
8
Symbol
BA[3:0]
reserved[1]
Reset
00000000
Access
R/W
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