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參數(shù)資料
| 型號(hào)： | IDT82V3202NLG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 39/117頁 |
| 文件大小： | 0K |
| 描述： | IC PLL WAN EBU SGL 68-VFQFPN |
| 標(biāo)準(zhǔn)包裝： | 21 |
| 類型： | 時(shí)鐘/頻率發(fā)生器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS |
| 輸出： | CMOS，LVDS，PECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 622.08MHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | 82V3202NLG |
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IDT82V3202
EBU WAN PLL
Functional Description
28
September 11, 2009
Table 13: Related Bit / Register in Chapter 3.8
Bit
Register
Address (Hex)
INn_CMOS 1 (n = 1 or 2)
INPUT_VALID1_STS
4A
INn_CMOS 2 (n = 1 or 2)
INTERRUPTS1_STS, INTERRUPTS2_STS
0D, 0E
INn_CMOS 3 (n = 1 or 2)
INTERRUPTS1_ENABLE_CNFG, INTERRUPTS2_ENABLE_CNFG
10, 11
INn_CMOS_NO_ACTIVITY_ALARM (n = 1 or 2)
IN1_IN2_CMOS_STS
44
INn_CMOS_FREQ_HARD_ALARM (n = 1 or 2)
INn_CMOS_PH_LOCK_ALARM (n = 1 or 2)
IN_NOISE_WINDOW
PHASE_MON_PBO_CNFG
78
ULTR_FAST_SW
MON_SW_PBO_CNFG
0B
LOS_FLAG_TO_TDO
T0_MAIN_REF_FAILED 1
INTERRUPTS2_STS
0E
T0_MAIN_REF_FAILED 2
INTERRUPTS2_ENABLE_CNFG
11
REVERTIVE_MODE
INPUT_MODE_CNFG
09
INn_CMOS_SEL_PRIORITY[3:0] (n = 1 or 2)
IN1_IN2_CMOS_SEL_PRIORITY_CNFG
27
CURRENTLY_SELECTED_INPUT[3:0]
PRIORITY_TABLE1_STS
4E
HIGHEST_PRIORITY_VALIDATED[3:0]
SECOND_HIGHEST_PRIORITY_VALIDATED[3:0]
PRIORITY_TABLE2_STS
4F
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