參數資料
型號: IDT72V51253L7.5BB
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: FIFO
英文描述: 128K X 18 OTHER FIFO, 4 ns, PBGA256
封裝: 17 X 17 MM, 1 MM PITCH, PLASTIC, BGA-256
文件頁數: 44/50頁
文件大?。?/td> 460K
代理商: IDT72V51253L7.5BB
49
IDT72V51233/72V51243/72V51253 3.3V, MULTI-QUEUE FLOW-CONTROL DEVICES
(4 QUEUES) 18 BIT WIDE CONFIGURATION 589,824, 1,179,648 and 2,359,296 bits
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
t4
t3
TDO
TDI/
TMS
TCK
TRST
tDO
Notes to diagram:
t1 = tTCKLOW
t2 = tTCKHIGH
t3 = tTCKFALL
t4 = tTCKRISE
t5 = tRST (reset pulse width)
t6 = tRSR (reset recovery)
5941 drw31
t5
t6
t1
t2
tTCK
tDH
tDS
Figure 29. Standard JTAG Timing
Parameter
Symbol
Test
Conditions
Min.
Max. Units
JTAG Clock Input Period tTCK
-
100
-
ns
JTAG Clock HIGH
tTCKHIGH
-40
-
ns
JTAG Clock Low
tTCKLOW
-40
-
ns
JTAG Clock Rise Time
tTCKRISE
--
5(1)
ns
JTAG Clock Fall Time
tTCKFALL
--
5(1)
ns
JTAG Reset
tRST
-50
-
ns
JTAG Reset Recovery
tRSR
-50
-
ns
JTAG
AC ELECTRICAL CHARACTERISTICS
(vcc = 3.3V
± 5%; Tcase = 0°C to +85°C)
NOTE:
1. 50pf loading on external output signals.
NOTE:
1. Guaranteed by design.
SYSTEM INTERFACE PARAMETERS
IDT72V51233
IDT72V51243
IDT72V51253
Parameter
Symbol
Test Conditions
Min.
Max.
Units
DataOutput
tDO(1)
-20
ns
Data Output Hold
tDOH(1)
0-
ns
Data Input
tDS
trise=3ns
10
-
ns
tDH
tfall=3ns
10
-
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