參數(shù)資料
型號(hào)： IBM25EMPPC603EBG-100
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, 100 MHz, RISC PROCESSOR, CBGA255
封裝： 21 X 21 MM, 1.27 MM PITCH, 3 MM HEIGHT, CERAMIC, BGA-255
文件頁(yè)數(shù)： 7/42頁(yè)
文件大?。?/td> 509K
代理商： IBM25EMPPC603EBG-100
603e and EM603e Hardware Specification
15
1.4.3 JTAG AC Timing Specications
Table 10 provides the JTAG AC timing specications as dened in Figure 5, Figure 6, Figure 7 and
Table 10. JTAG AC Timing Specifications
Vdd = AVdd = 2.5
± 5% Vdc (= 3.3 ± 5% Vdc for PID6). O Vdd = 3.3 ± 5% Vdc. GND = 0 Vdc, 0 ≤ Tj ≤ 105°C. C
L = 50 pF.
Num
Characteristic
Min
Max
Unit
Notes
TCK frequency of operation
0
16
MHz
1
TCK cycle time
62.5
—
ns
2
TCK clock pulse width measured at 1.4 V
25
—
ns
3
TCK rise and fall times
0
3
ns
4
TRST setup time to TCK rising edge
13
—
ns
1
5
TRST assert time
40
—
ns
6
Boundary scan input data setup time
6
—
ns
2
7
Boundary scan input data hold time
27
—
ns
2
8
TCK to output data valid
4
25
ns
3
9
TCK to output high impedance
3
24
ns
3
10
TMS, TDI data setup time
0
—
ns
11
TMS, TDI data hold time
25
—
ns
12
TCK to TDO data valid
4
24
ns
13
TCK to TDO high impedance
3
15
ns
Notes:
1. TRST is an asynchronous signal. The setup time is for test purposes only.
2. Non-test signal input timing with respect to TCK.
3. Non-test signal output timing with respect to TCK.
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PDF描述
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參數(shù)描述
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