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參數(shù)資料
型號： HW-V5GBE-DK-UNI-G-PROMO2
廠商： Xilinx Inc
文件頁數(shù)： 70/91頁
文件大小： 0K
描述： KIT DEV V5 LXT GIGABIT ETHERNET
產(chǎn)品變化通告： Product Notice_Dev Systems Product
標準包裝： 1
系列： Virtex®
類型： 開發(fā)套件
適用于相關產(chǎn)品： XC5VLX50T
所含物品： 板和軟件
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
72
TPSDCM/ TPHDCM
No Delay Global Clock and IFF(2) with DCM in
System-Synchronous Mode
XC5VTX150T
N/A
1.85
–0.33
2.05
–0.33
ns
XC5VTX240T
N/A
2.11
–0.32
2.35
–0.32
ns
XC5VFX30T
1.80
–0.28
1.89
–0.28
2.02
–0.28
ns
XC5VFX70T
1.76
–0.36
1.86
–0.36
1.98
–0.36
ns
XC5VFX100T
2.27
–0.51
2.35
–0.51
2.49
–0.49
ns
XC5VFX130T
2.33
–0.43
2.48
–0.43
2.72
–0.42
ns
XC5VFX200T
N/A
2.30
–0.23
2.43
–0.21
ns
Notes:
1.
Setup and Hold times are measured over worst case conditions (process, voltage, temperature). Setup time is measured relative to the
Global Clock input signal using the slowest process, highest temperature, and lowest voltage. Hold time is measured relative to the Global
Clock input signal using the fastest process, lowest temperature, and highest voltage. These measurements include DCM CLK0 jitter.
2.
IFF = Input Flip-Flop or Latch
3.
Use IBIS to determine any duty-cycle distortion incurred using various standards.
Table 92: Global Clock Setup and Hold With DCM in System-Synchronous Mode (Cont’d)
Symbol
Description
Device
Speed Grade
Units
-3
-2
-1
相關PDF資料
PDF描述
RBC12DCMI-S288 CONN EDGECARD 24POS .100 EXTEND
AMC06DRXH CONN EDGECARD 12POS .100 DIP SLD
GCC17DCST-S288 CONN EDGECARD 34POS .100 EXTEND
VI-B0M-EX-S CONVERTER MOD DC/DC 10V 75W
ISC1812BN1R2K INDUCTOR WW 1.2UH 10% 1812
相關代理商/技術參數(shù)
參數(shù)描述
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