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參數(shù)資料
| 型號： | GPTRM |
| 英文描述： | General-Purpose Timer Reference Manual |
| 中文描述： | 通用定時器參考手冊 |
| 文件頁數(shù)： | 30/90頁 |
| 文件大?。?/td> | 647K |
| 代理商： | GPTRM |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁當(dāng)前第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁
MOTOROLA
3-8
COMPARE/CAPTURE UNIT
GPT
REFERENCE MANUAL
Figure 3-7 Output Compare Registers (TOC1–4/TI4/O5)
3.3.3 Output Compare 1 (OC1)
Output compare 1 is unique because it can automatically affect any or all of the five
output compare pins (OC1–OC5) as a result of a successful output match. The two
registers that control this capability are the OC1 action mask register (OC1M) and the
OC1 action data register (OC1D). Refer to
Figure 3-8
.
Register OC1M specifies the output pins that are affected as a result of a successful
OC1 compare; register OC1D specifies the data to be transferred to the affected pins.
If an OC1 match and another output match occur at the same time and both attempt
to alter the same pin, the OC1 function controls the state of the pin.
This function allows control of multiple I/O pins automatically with a single output
match. It also allows more than one output compare function to control the state of a
single I/O pin. This allows pulses as short as one timer count to be generated.
Note: The address shown is on a word boundary; however, the register can be accessed by a word or byte cycle.
Figure 3-8 Action Mask and Action Data Registers (OC1M/OC1D)
OC1Mx — OC1 Mask Bits
0 = Corresponding bit in the parallel data port is not affected by OC1 compare.
1 = Corresponding bit in the parallel data port is affected by OC1 compare.
TOC1 —
Output Compare Registers 1
TOC2 —
Output Compare Registers 2
TOC3 —
Output Compare Registers 3
TOC4 —
Output Compare Registers 4
$YFF914
$YFF916
$YFF918
$YFF91A
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET:
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
TI4/O5 —
Input Capture 4/Output Compare 5 Register
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
0
0
0
0
0
0
0
RESET:
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
OC1M/OC1D —
OC1 Action Mask Register/OC1 Action Data Register
$YFF908
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
OC1M7
OC1M6 OC1M5 OC1M4 OC1M3
0
0
0
OC1D7 OC1D6 OC1D5 OC1D4 OC1D3
0
0
0
RESET:
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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