參數(shù)資料
型號(hào)： DS2196LN
元件分類： 通信及網(wǎng)絡(luò)
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數(shù)： 91/157頁
文件大小： 734K
代理商： DS2196LN
DS2196
91 of 157
BC2: BERT Control Register 2 (Address = 42 Hex)
(MSB)
EIB2
(LSB)
TC
EIB1
EIB0
SBE
–
–
–
SYMBOL
EIB2
POSITION
BC2.7
NAME AND DESCRIPTION
Error Insert Bit 2.
Will automatically insert bit errors at the
prescribed rate into the generated data pattern. Useful for
verifying error detection operation. Refer to Table 15-3 for
details.
Error Insert Bit 1.
Refer to Table 15-3 for details.
Error Insert Bit 0.
Refer to Table 15-3 for details.
Single Bit Error Insert.
A low to high transition will create a
single bit error. Must be cleared and set again for a subsequent
bit error to be inserted.
Not Assigned.
Should be set to 0 when written.
Not Assigned.
Should be set to 0 when written.
Not Assigned.
Should be set to 0 when written.
Transmit Pattern Load.
A low to high transition loads the
pattern generator with the pattern that is to be generated. This
bit should be toggled from low to high whenever the host
wishes to load a new pattern. Must be cleared and set again for
a subsequent loads.
EIB1
EIB0
SBE
BC2.6
BC2.5
BC2.4
–
–
–
BC2.3
BC2.2
BC2.1
BC2.0
TC
Table 15-3:
BERT RATE INSERTION SELECT
EIB2
0
0
0
0
1
1
1
1
EIB1
0
0
1
1
0
0
1
1
EIB0
0
1
0
1
0
1
0
1
Error Rate Inserted
No errors automatically inserted
10E-1
10E-2
10E-3
10E-4
10E-5
10E-6
10E-7
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PDF描述
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