參數(shù)資料
型號： DS2196LN
元件分類： 通信及網(wǎng)絡(luò)
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數(shù)： 139/157頁
文件大?。?/td> 734K
代理商： DS2196LN
DS2196
139 of 157
Figure 21-7:
TRANSMIT DATA FLOW
Idle Code / Per
Channel LB
= Register
= Device Pin
= Selector
TIR1 to TIR3
Software Signaling
Insertion
TS1 to TS12
Bit 7 Stuffing
F-Bit Mux
CRC Mux
AMI or B8ZS Converter /
Blue Alarm Gen.
Software Signaling Enable (TCR1.4)
To Waveshaping, Filters, and
Line Drivers
Transmit Blue (TCR1.1)
B8ZS Enable (CCR2.6)
CRC Insertion
Frame Mode Select (CCR2.7)
D4 Yellow Alarm Select (TCR2.1)
Transmit Yellow (TCR1.0)
TTR1 to TTR3
Bit 7 Zero Suppression Enable (TCR2.0)
Global Bit 7 Stuffing (TCR1.3)
Frame Mode Select (CCR2.7)
CRC Pass Through (TCR1.5)
Frame Mode Select (CCR2.7)
KEY:
D4 Bit 2 Yellow
Alarm Insertion
D4 12th Fs Bit
Yellow Alarm Gen.
Frame Mode Select (CCR2.7)
D4 Yellow Alarm Select (TCR2.1)
Transmit Yellow (TCR1.0)
ESF Yellow Alarm Gen.
(00FF Hex in the FDL)
Frame Mode Select (CCR2.7)
Transmit Yellow (TCR1.0)
1
0
1
0
1
0
0
1
DS2152 TRANSMIT DATA FLOW Figure 15.11
FPS or Ft Bit Insertion
TFDL Select (TCR1.2)
TFDL
TLINK
1
0
1
0
HDLC/BOC Enable (TBOC.6)
TIR Function Select (CCR4.0)
TIDR
1
0
RSER
(note#1)
In-Band Loop
Code Generator
IBCC
TDR
CCR3.1
NOTES:
1. TCLK should be tied to RCLK and TSYNC should be tied to
RFSYNC for data to be properly sourced from RSER.
TSER /
TDATA
1
0
HDLC
Controller
TDC2
1
0
TDC1.5
TCHBLK
FDL Mux
1
F-Bit Pass Through (TCR1.6)
TCD1 (4:0)
BOC
Controller
TBOC.7
1
0
BERT GENERATOR
& DETECTOR
ERROR INSERTION
FUNCTION
Error Rate Control (ERC)
Number of Errors (NOE1, NOE2)
BERT Function (Section 15)
C H 1-12 &
13-24
A IS Enable
CH 1-12 AIS Enable (CCR7.4)
CH 13-24 AIS Enable (CCR7.5)
CRC Calculation
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DS21Q44TN MICROSWITCH, SPDT, SIM ROLLER LEVER; Current, contact AC:5A; Force, operating:91.75gf; Travel, pre:16.0mm; Centres, fixing LxW:22.2mm; Temp, op. max:120(degree C); Temp, op. min:-40(degree C); Length / Height, external:9.25mm; Width, RoHS Compliant: Yes
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