參數(shù)資料
型號(hào)： DS2196LN
元件分類： 通信及網(wǎng)絡(luò)
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁(yè)數(shù)： 11/157頁(yè)
文件大?。?/td> 734K
代理商： DS2196LN
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DS2196
11 of 157
PIN
43
44
45
46
47
SYMBOL
TCLKOB
DVSS
DVDD
TCLKOA
TNEGOA /
TFSYNCA
TPOSOA /
TNRZA
TSERA
TCLKA
TSYNCA
TCHCLKA /
TLCLKA
TCHBLKA /
TLINKA
MUX
D0 / AD0
D1 / AD1
D2 / AD2
D3 / AD3
D4 / AD4
D5 / AD5
D6 / AD6
D7 / AD7
DVSS
DVDD
A0
A1
A2
A3
A4
A5
A6
A7 / ALE(AS)
RD*(DS*)
CS*
WR*(R/W*)
RCHBLKA /
RLINKA
RCHCLKA /
RLCLKA
RCLKIA
RPOSIA
RNEGIA
RCLKA
RSERA
RMSYNCA
RFSYNCA
RLOSA/
LOTCA
TYPE
O
–
–
O
O
FUNCTION
Transmit Clock Output from Formatter B.
Digital Signal Ground.
Digital Positive Supply. 3.3V (±5%).
Transmit Clock Output from Formatter A.
Transmit Negative Data Output from Formatter A /
Transmit Frame Sync Pulse Output from Formatter A.
Transmit Positive Data Output / Transmit NRZ Data Output from
Formatter A.
Transmit Serial Data Input for Formatter A.
Transmit Clock Input for Formatter A.
Transmit Frame & Multiframe Pulse for/from Formatter A.
Transmit DS0 Channel Clock Output from Formatter A /
Transmit FDL Link Clock Output from Formatter A.
Transmit Channel Blocking Clock Output from Formatter A /
Transmit FDL Link Data Input for Formatter A.
Bus Operation. 0 = Non-Mux Bus / 1 = Mux Bus Operation.
Data Bus Bit 0 / Address/Data Bus Bit 0. LSB.
Data Bus Bit 1 / Address/Data Bus Bit 1.
Data Bus Bit 2 / Address/Data Bus Bit 2.
Data Bus Bit 3 / Address/Data Bus Bit 3.
Data Bus Bit 4 / Address/Data Bus Bit 4.
Data Bus Bit 5 / Address/Data Bus Bit 5.
Data Bus Bit 6 / Address/Data Bus Bit 6.
Data Bus Bit 7 / Address/Data Bus Bit 7. MSB.
I/O Digital Signal Ground.
I/O Digital Positive Supply. 3.3V (±5%).
Address Bus Bit 0. LSB.
Address Bus Bit 1
Address Bus Bit 2
Address Bus Bit 3
Address Bus Bit 4
Address Bus Bit 5
Address Bus Bit 6
Address Bus Bit 7 / Address Latch Enable (Address Strobe). MSB.
Read Input (Data Strobe).
Chip Select. Active Low Signal.
Write Input (Read/Write).
Receive Channel Blocking Clock Output from Framer A /
Receive FDL Link Data Output from Framer A.
Receive DS0 Channel Clock Output from Framer A /
Receive FDL Link Clock Output from Framer A.
Receive Clock Input for Framer A.
Receive Positive & NRZ Data Input for Framer A.
Receive Negative & NRZ Data Input for Framer A.
Receive Clock Output from Framer A.
Receive Serial Data Output from Framer A.
Receive Multiframe Pulse from Framer A.
Receive Frame Pulse from Framer A.
Receive Loss Of Synchronization from Framer A /
Loss of Transmit Clock Framer A.
48
O
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I
I
I/O
O
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I
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
–
–
I
I
I
I
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I
I
I
I
I
O
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O
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I
I
I
O
O
O
O
O
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PDF描述
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