參數(shù)資料
型號： DS2196LN+
廠商： Maxim Integrated Products
文件頁數(shù)： 2/157頁
文件大小： 0K
描述： IC FRAMER DUAL T1 LIU 100-LQFP
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 90
控制器類型： T1 調幀器
接口： 并行/串行
電源電壓： 3.135 V ~ 3.465 V
電流 - 電源： 85mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應商設備封裝： 100-LQFP（14x14）
包裝： 托盤
DS2196
10 of 157
2. PIN DESCRIPTION
Table 2-1. Pin Description Sorted by Pin Number
PIN
SYMBOL
TYPE
FUNCTION
1
PCLK
I
Protect Clock Input.
2
PNRZ
I
Protect NRZ Data Input.
3
WCLK
I
Working Clock Input.
4
WNRZ
I
Working NRZ Data Input.
5
JTMS
I
IEEE 1149.1 Test Mode Select.
6
JTCLK
I
IEEE 1149.1 Test Clock Signal.
7
JTRST*
I
IEEE 1149.1 Test Reset.
8
JTDI
I
IEEE 1149.1 Test Data Input.
9
JTDO
O
IEEE 1149.1 Test Data Output.
10
RCL
O
Receive LIU Carrier Loss.
11
LNRZ
O
LIU NRZ & Positive Data Output.
12
LCLK
O
LIU Clock Output.
13
LFSYNC
O
LIU Frame Sync Pulse & Negative Data Output.
14
RPOSLO
O
Receive Positive & NRZ Data Output from the LIU.
15
RNEGLO
O
Receive Negative & NRZ Data Output from the LIU.
16
RCLKLO
O
Receive Clock Output from the LIU.
17
BTS
I
Bus Type Select. 0 = Intel / 1 = Motorola.
18
RTIP
I
Receive Analog Tip Input.
19
RRING
I
Receive Analog Ring Input.
20
RVDD
–
Receive Analog Positive Supply. 3.3V (±5%).
21
RVSS
–
Receive Analog Signal Ground.
22
INT*
O
Interrupt. Open Drain. Active Low Signal.
23
RVSS
–
Receive Analog Signal Ground.
24
MCLK
I
Master Clock Input. 1.544 MHz (±50 ppm).
25
UOP3
O
User Defined Output Port Bit 3.
26
UOP2
O
User Defined Output Port Bit 2.
27
UOP1
O
User Defined Output Port Bit 1.
28
UOP0
O
User Defined Output Port Bit 0.
29
TTIP
O
Transmit Analog Tip Output.
30
TVSS
–
Transmit Analog Signal Ground.
31
TVDD
–
Transmit Analog Positive Supply. 3.3V (±5%).
32
TRING
O
Transmit Analog Ring Output.
33
TPOSLI
I
Transmit Positive & NRZ Data for the LIU.
34
TNEGLI
I
Transmit Negative & NRZ Data for the LIU.
35
TCLKLI
I
Transmit Clock Input for the LIU.
36
TCHBLKB/
TLINKB
I/O
Transmit Channel Blocking Clock Output from Formatter B /
Transmit FDL Link Data Input for Formatter B.
37
TCHCLKB/
TLCLKB
O
Transmit DS0 Channel Clock Output from Formatter B /
Transmit FDL Link Clock Output from Formatter B.
38
TSYNCB
I/O
Transmit Frame & Multiframe Pulse for/from Formatter B.
39
TCLKB
I
Transmit Clock Input for Formatter B.
40
TSERB
I
Transmit Serial Data Input for Formatter B.
41
TPOSOB/
TNRZB
O
Transmit Positive Data Output from Formatter B /
Transmit NRZ Data Output from Formatter B.
42
TNEGOB /
TFSYNCB
O
Transmit Negative Data Output from Formatter B /
Transmit Frame Sync Pulse Output from Formatter B.
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