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參數(shù)資料
| 型號： | DS2156LN |
| 英文描述： | T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface |
| 中文描述： | T1/E1/J1單芯片收發(fā)器，TDM/UTOPIA II接口 |
| 文件頁數(shù)： | 222/262頁 |
| 文件大?。?/td> | 1515K |
| 代理商： | DS2156LN |
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DS2156
222 of 262
31.2 UTOPIA Backplane Mode
ATM traffic can be assigned on a fractional basis. See Section 24 for UTOPIA operation.
Register Name:
CCR3
Register Description:
Common Control Register 3
Register Address:
72h
Bit #
7
6
5
4
Name
TMSS INTDIS
CTTUI
CRRUI
Default
0
0
0
0
Bit 0/Receive Gapped-Clock Enable (RGPCKEN)
0 = RCHCLK functions normally
1 = enable gapped bit-clock output on RCHCLK
Bit 1/Receive Channel-Data Format (RDATFMT)
0 = 64kbps (data contained in all 8 bits)
1 = 56kbps (data contained in seven out of the 8 bits)
Bit 2/Transmit Gapped-Clock Enable (TGPCKEN)
0 = TCHCLK functions normally
1 = enable gapped bit-clock output on TCHCLK
Bit 3/Transmit Channel-Data Format (TDATFMT)
0 = 64kbps (data contained in all 8 bits)
1 = 56kbps (data contained in seven out of the 8 bits)
Bit 4/Connect RCLK to Receive UTOPIA Interface (CRRUI).
This bit selects either a constant clock (RCLK)
or a gapped clock from the framer (programmed by the user) as its data clock.
0 = gated clock is connected to receive UTOPIA interface
1 = RCLK is connected to receive UTOPIA interface
Bit 5/Connect TCLK to Transmit UTOPIA Interface (CTTUI).
This bit selects either a constant clock (TCLK)
or a gapped clock from the framer (programmed by the user) as its data clock.
0 = gated clock is connected to transmit UTOPIA interface
1 = TCLK is connected to transmit UTOPIA interface
Bit 6/Interrupt Disable (INTDIS).
This bit is convenient for disabling interrupts without altering the various
interrupt mask register settings.
0 = interrupts are enabled according to the various mask register settings
1 = interrupts are disabled regardless of the mask register settings
Bit 7/Transmit Multiframe Sync Source (TMSS).
Should be set = 0 only when transmit hardware signaling is
enabled.
0 = elastic store is source of multiframe sync
1 = framer or TSYNC pin is source of multiframe sync
3
2
1
0
TDATFMT
0
TGPCKEN
0
RDATFMT
0
RGPCKEN
0
相關PDF資料 |
PDF描述 |
|---|---|
| DS2182 | T1 Line Monitor |
| DS2182A | T1 Line Monitor |
| DS2186 | Transmit Line Interface |
| DS2187 | Receive Line Interface |
| DS2188 | T1/CEPT Jitter Attenuator |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| DS2156LN+ | 功能描述:網絡控制器與處理器 IC T1/E1/J1 Transceiver TDM/UTOPIA II Intrfc RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS216 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC |
| DS2160 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Data Encryption Processor |
| DS21600 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Clock Rate Adapter |
| DS21600N | 功能描述:時鐘發(fā)生器及支持產品 3.3/5V Clock Rate Adapter RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
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