參數(shù)資料
型號： DS2156LN
英文描述： T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
中文描述： T1/E1/J1單芯片收發(fā)器，TDM/UTOPIA II接口
文件頁數(shù)： 104/262頁
文件大小： 1515K
代理商： DS2156LN
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DS2156
104 of 262
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bits 0 to 5/Channel Pointer Address Bits (IAA0 to IAA5).
These bits select the channel to be programmed with
the idle code defined in the PCICR register.
IAA0 is the LSB of the 5-bit channel code. Channel 1 is 01h.
Bit 6/Global Transmit-Idle Code (GTIC).
Setting this bit causes all transmit channels to be set to the idle code
written to the PCICR register. This bit must be set = 0 for read operations. The value in bits IAA0–IAA5 must be a
valid transmit channel (01h to 20h for E1 mode; 01h to 18h for T1 mode).
Bit 7/Global Receive-Idle Code (GRIC).
Setting this bit causes all receive channels to be set to the idle code
written to the PCICR register. This bit must be set = 0 for read operations. The value in bits IAA0–IAA5 must be a
valid transmit channel (01h to 20h for E1 mode; 01h to 18h for T1 mode).
Table 16-B. GRIC and GTIC Functions
IAAR
Idle Array Address Register
7Eh
7
6
5
4
3
2
1
0
GRIC
0
GTIC
0
IAA5
0
IAA4
0
IAA3
0
IAA2
0
IAA1
0
IAA0
0
GRIC
0
0
1
1
GTIC
0
1
0
1
FUNCTION
Updates a single transmit or receive channel
Updates all transmit channels
Updates all receive channels
Updates all transmit and receive channels
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bits 0 to 7/Per-Channel Idle-Code Bits (C0 to C7).
This register defines the idle code to be programmed in the
channel selected by the IAAR register.
C0 is the LSB of the idle code (this bit is transmitted last).
PCICR
Per-Channel Idle Code
Register
7Fh
7
C7
0
6
C6
0
5
C5
0
4
C4
0
3
C3
0
2
C2
0
1
C1
0
0
C0
0
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PDF描述
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