參數(shù)資料
型號(hào)： DS2156LN
英文描述： T1/E1/J1 Single-Chip Transceiver TDM/UTOPIA II Interface
中文描述： T1/E1/J1單芯片收發(fā)器，TDM/UTOPIA II接口
文件頁(yè)數(shù)： 221/262頁(yè)
文件大?。?/td> 1515K
代理商： DS2156LN
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DS2156
221 of 262
30.
The DS2156 contains an on-chip clock synthesizer that generates a user-selectable clock output on the
BPCLK pin, referenced to the recovered receive clock (RCLK). The synthesizer uses a phase-locked loop
to generate low-jitter clocks. Common applications include generation of port and backplane system
clocks. The CCR2 register is used to enable (CCR2.0) and select (CCR2.1 and CCR2.2) the clock
frequency of the BPCLK pin.
Register Name:
CCR2
Register Description:
Common Control Register 2
Register Address:
71h
Bit #
7
6
5
4
Name
TRPA4
TRPA3
TRPA2
TRPA1
TRPA0
Default
0
0
0
0
Bit 0/Backplane Clock Enable (BPEN)
0 = disable BPCLK pin (pin held at logic 0)
1 = enable BPCLK pin
Bits 1, 2/Backplane Clock Selects (BPCS0, BPCS1)
BPCS1
BPCS0
BPCLK Frequency (MHz)
0
0
16.384
0
1
8.192
1
0
4.096
1
1
2.048
Bits 3 to 7/UTOPIA Port Address (TRPA0 to TRPA4).
See
Register Definitions
in Section 24.7.
31.
FRACTIONAL T1/E1 SUPPORT
31.1 TDM Backplane Mode
The DS2156 can be programmed to output gapped clocks for selected channels in the receive and
transmit paths to simplify connections into a USART or LAPD controller in fractional T1/E1 or ISDN-
PRI applications. The receive and transmit paths have independent enables. Channel formats supported
include 56kbps and 64kbps. This is accomplished by assigning an alternate function to the RCHCLK and
TCHCLK pins. Setting CCR3.0 = 1 causes the RCHCLK pin to output a gapped clock as defined by the
receive fractional T1/E1 function of the PCPR register. Setting CCR3.2 = 1 causes the TCHCLK pin to
output a gapped clock as defined by the transmit fractional T1/E1 function of the PCPR register. CCR3.1
and CCR3.3 can be used to select between 64kbps and 56kbps operation. See Section 5 for details about
programming the per-channel function. In T1 mode no clock is generated at the F-bit position.
When 56kbps mode is selected, the LSB clock in the channel is omitted. Only the seven most significant
bits of the channel have clocks.
PROGRAMMABLE BACKPLANE CLOCK SYNTHESIZER
3
2
1
0
BPCS1
0
BPCS0
0
BPEN
0
0
相關(guān)PDF資料
PDF描述
DS2182 T1 Line Monitor
DS2182A T1 Line Monitor
DS2186 Transmit Line Interface
DS2187 Receive Line Interface
DS2188 T1/CEPT Jitter Attenuator
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
DS2156LN+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T1/E1/J1 Transceiver TDM/UTOPIA II Intrfc RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS216 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog IC
DS2160 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Data Encryption Processor
DS21600 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Clock Rate Adapter
DS21600N 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 3.3/5V Clock Rate Adapter RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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